搜索：频率特性测试仪

其他  用VHDL 语言描述频率计的设计

用VHDL 语言描述频率计的设计，其开发均在FPGA中

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汇编语言  IIR型3阶切比雪夫1型高通滤波器的采样频率（Fs)为1200Hz,截至频率为200Hz

IIR型3阶切比雪夫1型高通滤波器的采样频率（Fs)为1200Hz,截至频率为200Hz

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操作系统开发  osapi 2.0 操作系统抽象层 "系统抽象层"使得你可以实现一种对于RTOS、CPU和所运行产品物理特性完全透明的软件。使用这种公共通用接口

osapi 2.0 操作系统抽象层 "系统抽象层"使得你可以实现一种对于RTOS、CPU和所运行产品物理特性完全透明的软件。使用这种公共通用接口，高层软件在并不了解底层硬件特性的情况下也可以访问底层服务，比如对非易失性内存的读写。 ...

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其他  构造一组输入为白噪声加三个频率非常接近的正弦波

构造一组输入为白噪声加三个频率非常接近的正弦波，其信噪比为10dB，观测长度为256。试分别用普通AR谱估计和采用功率噪声抵消算法的AR谱估计估计这组信号的频率，并比较结果。

https://www.eeworm.com/dl/534/220972.html

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系统设计方案  这是一个基于FPGA的频率计和相位计的设计方案

这是一个基于FPGA的频率计和相位计的设计方案

https://www.eeworm.com/dl/678/221023.html

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matlab例程  声卡采集的程序,可设置采样频率,位长,采样时间等参数.可采样8k-44.1kHz的信号,进行频谱分析.

声卡采集的程序,可设置采样频率,位长,采样时间等参数.可采样8k-44.1kHz的信号,进行频谱分析.

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单片机开发  测试频率基于C8051F330单片机的频率测试频率测试精度：0.1Hz

测试频率基于C8051F330单片机的频率测试频率测试精度：0.1Hz

https://www.eeworm.com/dl/648/221957.html

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VHDL/FPGA/Verilog 直接数字式频率合成器(DDS)设计实验(电子设计竞赛赛题) 其它详细资料说明请参考 http://www.kx-soc.com

直接数字式频率合成器(DDS)设计实验(电子设计竞赛赛题) 其它详细资料说明请参考 http://www.kx-soc.com

https://www.eeworm.com/dl/663/222021.html

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VHDL/FPGA/Verilog 显示频率测量

显示频率测量，外接24MHz晶振，显示数据为三位，分四个档来测量

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Internet/网络编程  asp.net 2.0 WebPart应用. 使用Web部件创建模块化的Web门户应用；个人化特性和自定义特性；将自定义用户控件作为Web部件使用；创建一个个人化特性的提供程序；

asp.net 2.0 WebPart应用. 使用Web部件创建模块化的Web门户应用；个人化特性和自定义特性；将自定义用户控件作为Web部件使用；创建一个个人化特性的提供程序；现今门户应用非常流行，好的门户都有共同而显著的特点。那就是都会给访问者提供雅观的信息，并且这些信息都是通过模块化的、一致的、易于浏览的用户界面提 ...

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