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VHDL/FPGA/Verilog 一个有效位为4位的十进制的数字频率计,VHDL语言编写

一个有效位为4位的十进制的数字频率计,VHDL语言编写，已在硬件实验箱上实验通过。

https://www.eeworm.com/dl/663/214737.html

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系统设计方案  摘要：介绍了基于可编程逻辑器件CPLD和直接数字频率合成技术（DDS）的三相多波形函数发生器的基本原理

摘要：介绍了基于可编程逻辑器件CPLD和直接数字频率合成技术（DDS）的三相多波形函数发生器的基本原理，并在此基础上给出了基于CPLD的各模块设计方法及其VHDL源程序

https://www.eeworm.com/dl/678/214819.html

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人工智能/神经网络  使用VC2005编写的自己生成不同频率的数据

使用VC2005编写的自己生成不同频率的数据，使用FFT算法进行处理，显示。非常适合VC初学者效仿

https://www.eeworm.com/dl/650/215487.html

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其他  这是简易数字频率计题解的幻灯片

这是简易数字频率计题解的幻灯片，希望对大家有用。

https://www.eeworm.com/dl/534/215557.html

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单片机开发  AVR 通用 Bootloader 使用说明支持多种型号的AVR单片机支持多串口的AVR单片机支持RS232/RS485/RS422模式支持多种通信波特率和时钟频率 *自动计

AVR 通用 Bootloader 使用说明 *支持多种型号的AVR单片机 *支持多串口的AVR单片机 *支持RS232/RS485/RS422模式 *支持多种通信波特率和时钟频率 *自动计算波特率误差，如果波特率误差>2％，将给出错误提示 *完全C语言编写，容易修改 *为移植做了很多优化，将移植的工作量减少到了最低 *代码高度优化，占用空间小 *方便的功能 ...

https://www.eeworm.com/dl/648/215761.html

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单片机开发  基于51单片机的频率合成设计论文【同学捐助】基于51单片机的频率合成设计论文【同学捐助】

基于51单片机的频率合成设计论文【同学捐助】基于51单片机的频率合成设计论文【同学捐助】

https://www.eeworm.com/dl/648/215796.html

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其他  自定义多目录替换字符工具表的对照关系 -------------------------------- 原表新表 ------------------------------

自定义多目录替换字符工具表的对照关系 -------------------------------- 原表新表 -------------------------------- syskind , DictType syscode , DictCode

https://www.eeworm.com/dl/534/215905.html

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其他  设采样频率为1Hz

设采样频率为1Hz，对于淹没在复高斯白噪声中的信噪比为的两个复LFM信号，采用子带带宽为0.1Hz的升余弦滤波器，共9个子带滤波器构成的滤波器组，时间窗为窗长为256的矩形窗，进行仿真

https://www.eeworm.com/dl/534/215975.html

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其他  在采样频率为1Hz

在采样频率为1Hz，数据长度为1000点和信噪比为10dB的条件下，进行PPS信号的DPT迭代检测

https://www.eeworm.com/dl/534/215978.html

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技术管理  找了很久才找到的MODBUS中英文对照版本,才开发MODBUS规约的过程中,很有参考价值

找了很久才找到的MODBUS中英文对照版本,才开发MODBUS规约的过程中,很有参考价值

https://www.eeworm.com/dl/642/216058.html

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