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其他 2.0G频率计的制作全过程 是pdf格式的
2.0G频率计的制作全过程
是pdf格式的
VHDL/FPGA/Verilog 基于单片机与CPLD的 等精度频率计
基于单片机与CPLD的 等精度频率计，VHDL语言
VHDL/FPGA/Verilog 一个verilog语言描写的同步fifo,包括:Fifo using declared registers for storage和Fifo using (model of) standard mem
一个verilog语言描写的同步fifo,包括:Fifo using declared registers for storage和Fifo using (model of) standard memory chip for storage.两种方式,包含testbench
单片机开发 用凌阳16位单片机测试输入波形的频率
用凌阳16位单片机测试输入波形的频率，动态刷新显示
单片机开发 用凌阳单片机输入频率控制并输出14位2进制码锁住相应频率
用凌阳单片机输入频率控制并输出14位2进制码锁住相应频率
网络 NTP协议的实现 可以使用该程序将linux主机的时间和网络ntp server同步时间
NTP协议的实现
可以使用该程序将linux主机的时间和网络ntp server同步时间
VHDL/FPGA/Verilog 频率计
频率计，vhdl语言， ispDesignEXPERT
通讯/手机编程 使用VB的OPC客户访问的最简单程序,本程序为同步访问程序,需要异步的查找ASync-VB.rar
使用VB的OPC客户访问的最简单程序,本程序为同步访问程序,需要异步的查找ASync-VB.rar
微处理器开发 此为基于ARM7编写的,采用周立功LPC2131系列ARM编写,用的是C语言,实现的是DDS AD9850 正弦波产生,晶振(参考频率)为PWM6产生,外围电路参照有关电路,不管何总都一样.
此为基于ARM7编写的,采用周立功LPC2131系列ARM编写,用的是C语言,实现的是DDS AD9850 正弦波产生,晶振(参考频率)为PWM6产生,外围电路参照有关电路,不管何总都一样.