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VHDL/FPGA/Verilog 显示频率测量
显示频率测量，外接24MHz晶振，显示数据为三位，分四个档来测量
软件设计/软件工程 基于CD4046构成的PLL及应用 CD4046构成的PLL在通信、频率处理、自动控制等技术领域中应用较为广泛
基于CD4046构成的PLL及应用
CD4046构成的PLL在通信、频率处理、自动控制等技术领域中应用较为广泛，正确理解CD4046对掌握电路基本组成、原理及应用。对处理实际工程问题有很大帮助
软件设计/软件工程 基于MC145159的PLL频率合成器设计与实现 介绍了锁相环路频率合成器的基本原理,分析了集成锁相环芯片M C 145159的工作特性,给出了集成锁相环芯片M C 145159的一个应用实例,为高
基于MC145159的PLL频率合成器设计与实现
介绍了锁相环路频率合成器的基本原理,分析了集成锁相环芯片M C 145159的工作特性,给出了集成锁相环芯片M C 145159的一个应用实例,为高频频率合成器的设计提供了一个较好的思路.测试结果证明了设计的合理性与实用性,系统频率稳定度优于10-7. ...
VHDL/FPGA/Verilog xilinx提供的频率发生器的VHDL源码
xilinx提供的频率发生器的VHDL源码，可以运行在spartan3的学习开发板上。
多国语言处理 语音合成PSOLA算法实现 语音合成PSOLA算法实现
语音合成PSOLA算法实现
语音合成PSOLA算法实现
单片机开发 频率计是用单片机89C51和几块数字电路几个三极管
频率计是用单片机89C51和几块数字电路几个三极管
VHDL/FPGA/Verilog 等精度频率计的verilogHDL的实现,我花了好长时间才写的哦
等精度频率计的verilogHDL的实现,我花了好长时间才写的哦
其他 组合频率干扰,用于通信等射频电路中干扰的计算
组合频率干扰,用于通信等射频电路中干扰的计算
其他嵌入式/单片机内容 一个基于quartus2的等精度频率计的设计
一个基于quartus2的等精度频率计的设计，主要采用的verilogＨＤＬ语言
数学计算 利用渐进结构优化算法（ESO）实现矩形板的第一阶频率的最大化。用VC实现界面
利用渐进结构优化算法（ESO）实现矩形板的第一阶频率的最大化。用VC实现界面，以Nastran作为频率求解器，用Matlab进行数值运算。