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频率合成器 的查询结果
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VHDL/FPGA/Verilog DDs直接数字频率合成器的源代码
DDs直接数字频率合成器的源代码，其中包括采用IP核和普通两种方式
VHDL/FPGA/Verilog 频率合成器实例模块（VHDL编写）
频率合成器实例模块（VHDL编写）
单片机开发 数字频率合成器DDS9851控制系统的单片机源代码
数字频率合成器DDS9851控制系统的单片机源代码，键盘输入频率，液晶显示，并实时输出所需频率，该系统可选择输出方波和正弦波。
单片机开发 脉冲发生测试.此程序为AD9850（DDS）直接数字频率合成器C语言源码。用125M的有源晶振
脉冲发生测试.此程序为AD9850（DDS）直接数字频率合成器C语言源码。用125M的有源晶振，频率无失真输出可达到40M。
VHDL/FPGA/Verilog 本章介绍了两个EDA技术的综合应用设计实例:数字闹钟和直接数字频率合成器DDS。
本章介绍了两个EDA技术的综合应用设计实例:数字闹钟和直接数字频率合成器DDS。
单片机开发 数字频率合成器DDS9851的驱动程序实验
数字频率合成器DDS9851的驱动程序实验
单片机开发 9850dds 频率合成器 51单片机控制的可调频率可调幅度的驱动程序
9850dds 频率合成器 51单片机控制的可调频率可调幅度的驱动程序
VHDL/FPGA/Verilog 基于FPGA的直接数字频率合成器（DDS）设计 （源程序）
基于FPGA的直接数字频率合成器（DDS）设计
（源程序）
单片机开发 此为89C2051控制DDS频率合成器AD9850,内含51之组合语言之程式码以及其电路图,电路图为一般图档.
此为89C2051控制DDS频率合成器AD9850,内含51之组合语言之程式码以及其电路图,电路图为一般图档.
文件格式 此为使用DDS直接数字频率合成器之设计报告,作者相当的详细介绍DDS之原理以及使用Altera之FPGA做设计,供使用者参考.
此为使用DDS直接数字频率合成器之设计报告,作者相当的详细介绍DDS之原理以及使用Altera之FPGA做设计,供使用者参考.