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单片机开发 1)MCS51内核
1)MCS51内核，可以利用单片及开发软件Keil软件方便开发mp3播放器，无需特殊软件平台；
2)MPEG I/II-Layer 3 hardware decoder
.独立MP3 Decoder
.支持48,44.1,32,24,22.05,16khz取样频率
.支持软件31阶音量控制,高中低音均衡控制
.重低音效果
3)集成DAC部件，支持PCM,IIS格式；
4)64K字节片上代码存储空间（100K次 ...
单片机开发 自己制作51开发板. 带自恢复保险丝
自己制作51开发板.
带自恢复保险丝，试验安全，40Pin锁紧插座适用于4～40脚芯片，可以自由配置电源引脚。
板上资源:
1、6个高亮数码管显示（数字和字母显示）
2、8个独立优质按键（2Pin）（人机接口输入）
3、8个高亮发光二极管（跑马灯、指示灯、红绿灯等）
4、标准的RS232通信接口（PC通信）
5、一体化红外接收头（高灵敏 ...
嵌入式/单片机编程 广嵌GEC2410开发板实验程序及PDF文档 GEC2410实战手册目录 一、基本接口实验 1.1 ARM汇编指令编程实验 1.2 Thumb和ARM指令混合编程实验 1.3 C和AR
广嵌GEC2410开发板实验程序及PDF文档
GEC2410实战手册目录
一、基本接口实验
1.1 ARM汇编指令编程实验
1.2 Thumb和ARM指令混合编程实验
1.3 C和ARM汇编混合编程实验
1.4 C编程实现LED控制实验
1.5 ARM启动及工作模式切换实验
1.6 外部中断应用实验
1.7 看门狗定时器应用实验
1.8 PWM控制蜂鸣器实验
1.9 实时时钟及 ...
论文 基于单片机的恒流开关电源
本开关电源设计采用STC12C5A60S2单片机发生47KHZ的PWM脉冲信号，经过IR2104控制MOS，从而控制整个BUCK（降压式变换）电路。单片机内部自带的10位ADC能通过电压电流检测电流实时反馈电流和电压数值，并由此调整输出的PWM的占空比，形成电流电压闭环控制系统。按键能设置输出电流从0.2A到2A，以0.01A递增，输出最大10V，液 ...
技术资料 模拟集成电路设计精粹版高清版.pdf.part1
模拟集成电路设计精粹版高清版《模拟集成电路设计精粹》作者首先对MOST和BJT两种器件模型进行了分析和比较，然后以此为两条线索，分别介绍了相应的基本单元电路和各类放大器的详细分析，随后的章节分别研究噪声、失真、滤波器、ADC/DAC和振荡器电路，每一章都结合MOST和BJT两种类型电路进行分析比较。本书一方面侧重于基础 ...
技术资料 基于FPGA的电压电流温度监测系统设计与实现.rar
对一些信号的监测尤其是对电压、电流、温度等模拟量的监测有着很广泛的应用，通过监测到的数据，可以对系统相关设置进行及时调整，为人们的生产生活带来便利与保证。 系统采用Actel公司先进的模数混合FPGA以及Actel公司的SOPC设计解决方案，单芯片实现以CortexMI处理器为核心的片上监测系统。它可以完成对电压、电流、温度 ...
技术资料 C8051F93x-C8051F92x 低功耗混合信号 ISP FLASH 微控制器 数据手册
C8051F920/30引脚图与中文资料下载,低功耗51单片机低功耗的一个选项供电电压 0.9V ~ 3.6V单节电池模式支持 0.9~1.8V 操作双节电池模式支持 1.8~3.6V 操作内建 DC-DC 转换器，可输出 1.8~3.3V，用于单节电池模式内建 LDO 稳压器，允许高模拟电压和低数字内核电压10 位 ADC两个比较器6 位可编程电流基准在片调试高速 8051 微 ...
模拟电子 时钟分相技术应用
摘要: 介绍了时钟分相技术并讨论了时钟分相技术在高速数字电路设计中的作用。
关键词: 时钟分相技术; 应用
中图分类号: TN 79 文献标识码:A 文章编号: 025820934 (2000) 0620437203
时钟是高速数字电路设计的关键技术之一, 系统时钟的性能好坏, 直接影响了整个电路的
性能。尤其现代电子系统对性能的越来越高 ...
学术论文 光伏并网发电系统的研究与设计.rar
在能源枯竭环境污染日益严重的今天，光伏发电结合其自身的特点，日益得到各国的重视并将成为各国竞向发展的热点。而光伏并网发电又是光伏利用中的发展趋势，基于此，本文对单相并网发电系统进行了研究，并设计了一台1.5KW的单相光伏并网装置。在对主电路拓扑、MPPT、防孤岛效应、逆变并网控制方法详细分析的基础上，选用了 ...
学术论文 MIMO-GMC系统中Turbo译码器的设计及FPGA实现
Turbo码是一类并行级联的系统卷积码，它是在综合级联码、最大后验概率(MAP)译码、软输入软输出及迭代译码等理论基础上的一种创新。Turbo码的基本原理是通过对编码器结构的巧妙设计，多个子码通过交织器隔离进行并行级联编码输出，增大了码距。译码器则以类似内燃机引擎废气反复利用的机理进行迭代译码以反复利用有效信息流 ...