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单片机开发  用凌阳单片机输入频率控制并输出14位2进制码锁住相应频率

用凌阳单片机输入频率控制并输出14位2进制码锁住相应频率

https://www.eeworm.com/dl/648/234430.html

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RFID编程  DPLL由鉴相器模K加减计数器脉冲加减电路同步建立侦察电路模N分频器构成. 整个系统的中心频率(即signal_in和signal_out的码速率的2倍) 为clk/8/N. 模K

DPLL由鉴相器模K加减计数器脉冲加减电路同步建立侦察电路模N分频器构成. 整个系统的中心频率(即signal_in和signal_out的码速率的2倍) 为clk/8/N. 模K加减计数器的K值决定DPLL的精度和同步建立时间,K越大,则同步建立时间长,同步精度高.反之则短,低. ...

https://www.eeworm.com/dl/697/248673.html

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单片机开发  简易数字频率计利用复杂可编程逻辑器件FPGA,VHDL编程将所有功能模块集成在一块芯片上。功能模块包括时基脉冲发生器、计数器、数据锁存器和显示电路4部分。设计时先分别设计各功能模块

简易数字频率计利用复杂可编程逻辑器件FPGA,VHDL编程将所有功能模块集成在一块芯片上。功能模块包括时基脉冲发生器、计数器、数据锁存器和显示电路4部分。设计时先分别设计各功能模块，并调试得到正确仿真结果，然后将各个功能模块组合起来。最后作整体仿真、下载，得到实物。由于采用纯数字硬件设计制作，稳定性、可靠性远 ...

https://www.eeworm.com/dl/648/273696.html

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加密解密  在FFT后信号的频率往往与谱线不相重合

在FFT后信号的频率往往与谱线不相重合，而在两条谱线之间。为了要求得信号的频率、幅值和初始相角，必须要使用修正法来完成。这里给出一种修正法。

https://www.eeworm.com/dl/519/280428.html

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VHDL/FPGA/Verilog 用VHDL实现数字频率计,1. 时基产生与测频时序控制电路模块2. 待测信号脉冲计数电路模块3.锁存与译码显示控制电路模块4.顶层电路模块.

用VHDL实现数字频率计,1. 时基产生与测频时序控制电路模块2. 待测信号脉冲计数电路模块3.锁存与译码显示控制电路模块4.顶层电路模块.

https://www.eeworm.com/dl/663/304246.html

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单片机开发  计算离散时间信号的DTFT 计算离散时间系统的相延迟和群延迟计算离散时间系统的频率响应

计算离散时间信号的DTFT 计算离散时间系统的相延迟和群延迟计算离散时间系统的频率响应，画幅频和相频图

https://www.eeworm.com/dl/648/309573.html

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VHDL/FPGA/Verilog 实现低频率的移相信号发生器,才用DDS技术直接的合成

实现低频率的移相信号发生器,才用DDS技术直接的合成

https://www.eeworm.com/dl/663/327630.html

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matlab例程  文章运用分级抽取和多相滤波的方法改进传统CIC滤波器的结构,降低了系统工作频率,运用幅度改进函数(ACF)和外加级联余弦预滤波器的技术改进了滤波器频率响应,提出了一种高效的算法结构,改善了通带损耗,增

文章运用分级抽取和多相滤波的方法改进传统CIC滤波器的结构,降低了系统工作频率,运用幅度改进函数(ACF)和外加级联余弦预滤波器的技术改进了滤波器频率响应,提出了一种高效的算法结构,改善了通带损耗,增大了阻带衰减,对CIC滤波器的实际应用和深入研究有着现实意义。 ...

https://www.eeworm.com/dl/665/332255.html

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嵌入式/单片机编程  使用Verilog语言编写的使用SPI总线设置频率LM2346,可通过设置其R寄存器对其输出频率进行设置（需相应的射频电路相配合）。

使用Verilog语言编写的使用SPI总线设置频率LM2346,可通过设置其R寄存器对其输出频率进行设置（需相应的射频电路相配合）。

https://www.eeworm.com/dl/647/424879.html

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通讯编程文档  基于MCS-51单片机调频调相信号发生器功能:A路能产生2~200HZ/分钟频率可调 @ B路能产生同A路相位滞后0~180读可调 @ 可以键盘设定频率和相位 @ 可

基于MCS-51单片机调频调相信号发生器功能:A路能产生2~200HZ/分钟频率可调 @ B路能产生同A路相位滞后0~180读可调 @ 可以键盘设定频率和相位 @ 可以显示频率和相位

https://www.eeworm.com/dl/646/440158.html