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找到约 3,153 项符合 采样保持放大器 的查询结果

单片机开发 SH301.C A/D采样的单片机例程 SH302.C 基于89C2051的电压采样程序 SH303.C 单片机的电流检测程序 304 仪表放大器芯片的使用 不提供程序。 SH305.C

SH301.C A/D采样的单片机例程 SH302.C 基于89C2051的电压采样程序 SH303.C 单片机的电流检测程序 304 仪表放大器芯片的使用 不提供程序。 SH305.C DS1820温度测量程序 SH306.C HMR3000数字罗盘的读数程序 SH307.C GPS的读数程序 需要加上液晶显示部分的程序 ...
https://www.eeworm.com/dl/648/185305.html
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单片机开发 TLC549是一种采用8位逐次逼近式工作的A/D转换器。内部包含系统时钟、采样和保持、8位A/D转换器、数据寄存器以及控制逻辑电路。TLC549每25uS重复一次“输入—转换—输出”。器件有两个控制输

TLC549是一种采用8位逐次逼近式工作的A/D转换器。内部包含系统时钟、采样和保持、8位A/D转换器、数据寄存器以及控制逻辑电路。TLC549每25uS重复一次“输入—转换—输出”。器件有两个控制输入:I/O CLOCK和片选(CS)。 内部系统时钟和I/O CLOCK可独立使用。应用电路的设计只需利用I/O时钟启动转换或读出转换结果。当CS为 ...
https://www.eeworm.com/dl/648/226044.html
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单片机开发 LTC1446是一种采用12位逐次逼近式工作的A/D转换器。内部包含系统时钟、采样和保持、12位A/D转换器、数据寄存器以及控制逻辑电路。LTC1446每25uS重复一次“输入——转换——输出”。器件

LTC1446是一种采用12位逐次逼近式工作的A/D转换器。内部包含系统时钟、采样和保持、12位A/D转换器、数据寄存器以及控制逻辑电路。LTC1446每25uS重复一次“输入——转换——输出”。器件有两个控制输入:DIN CLK和片选(CS)。 内部系统时钟和DIN CLK可独立使用。应用电路的设计只需利用时钟启动转换或读出转换结果。当CS为 ...
https://www.eeworm.com/dl/648/226047.html
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其他嵌入式/单片机内容 信号的采样与保持

信号的采样与保持
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串口编程 UART 处理的是并行数据转换为串行信号和串行信号转换为并行数据。现有的时钟不精确,这就需要用一个远高于波特率的本地时钟信号对输入信号不断采样,以不断让接收器与发送器保持同步。

UART 处理的是并行数据转换为串行信号和串行信号转换为并行数据。现有的时钟不精确,这就需要用一个远高于波特率的本地时钟信号对输入信号不断采样,以不断让接收器与发送器保持同步。
https://www.eeworm.com/dl/624/301371.html
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其他书籍 运算放大器稳定性分析:何时转变为.在写保持容性负载稳定的六种方法

运算放大器稳定性分析:何时转变为.在写保持容性负载稳定的六种方法
https://www.eeworm.com/dl/542/363193.html
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其他嵌入式/单片机内容 SH301.C A/D采样的单片机例程 SH302.C 基于89C2051的电压采样程序 SH303.C 单片机的电流检测程序 304 仪表放大器芯片的使用 不提供程序。 SH305.C

SH301.C A/D采样的单片机例程 SH302.C 基于89C2051的电压采样程序 SH303.C 单片机的电流检测程序 304 仪表放大器芯片的使用 不提供程序。 SH305.C DS1820温度测量程序 SH306.C HMR3000数字罗盘的读数程序 SH307.C GPS的读数程序 需要加上液晶显示部分的程序 ...
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学术论文 基于FPGA的PWMD类音频功率放大器的设计.rar

数字D类音频放大器,也叫数字脉冲调制放大器,具有效率高,低电压,低失真的特点,在低成本,高性能的消费类产品特别是便携式设备中得到越来越广泛的应用。数字D类放大器包括数字脉冲宽度调制(PWM)和输出级(含低通滤波器)两个部分,数字PWM又包括两个部分,采样处理和脉冲产生。传统的采样处理算法运算复杂,硬件实现成 ...
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学术论文 基于DSP的数字音频功率放大器的设计

· 摘要:  提出并设计了一种新型音频功率放大器.该系统通过高速采样,多采样率的插值运算,半带低通滤波以及∑-△调制,将音频PCM信号转换成二进制序列,经过高速开关管还原出具有原始功率谱的功率信号.该功率放大器具有D类数字功放高效率特点的同时,能够保证高保真的还原性,并且具有进一步提升信噪比的空间. & ...
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模拟电子 带有增益提高技术的高速CMOS运算放大器设计

设计了一种用于高速ADC中的高速高增益的全差分CMOS运算放大器。主运放采用带开关电容共模反馈的折叠式共源共栅结构,利用增益提高和三支路电流基准技术实现一个可用于12~14 bit精度,100 MS/s采样频率的高速流水线(Pipelined)ADC的运放。设计基于SMIC 0.25 μm CMOS工艺,在Cadence环境下对电路进行Spectre仿真。仿真结 ...
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