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VHDL/FPGA/Verilog 简述了V HDL 语言的功能及其特点,并以 8 位串行数字锁设计为例,介绍了在Max + plus Ⅱ10. 2 开发软件下,利用V HDL 硬件描述语言设计数字逻辑电路的过程和方法。并设计了密

简述了V HDL 语言的功能及其特点,并以 8 位串行数字锁设计为例,介绍了在Max + plus Ⅱ10. 2 开发软件下,利用V HDL 硬件描述语言设计数字逻辑电路的过程和方法。并设计了密码锁

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VHDL/FPGA/Verilog 本书详细介绍了VHDL语言设计数字逻辑电路和数字系统的过程和方法

本书详细介绍了VHDL语言设计数字逻辑电路和数字系统的过程和方法，并对设计中各种相关技术做了详细的介绍，出此之外，本书提供了丰富的实例，条理清晰，通俗易懂。

https://www.eeworm.com/dl/663/313846.html

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其他  移位相加8位硬件乘法器电路设计乘法器是数字系统中的基本逻辑器件

移位相加8位硬件乘法器电路设计乘法器是数字系统中的基本逻辑器件，在很多应用中都会出现如各种滤波器的设计、矩阵的运算等。本实验设计一个通用的8位乘法器。

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VHDL/FPGA/Verilog VHDL硬件描述语言与数字逻辑电路设计,学习VHDL的好资料

VHDL硬件描述语言与数字逻辑电路设计,学习VHDL的好资料

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其他  自己做的数字逻辑电路课程设计

自己做的数字逻辑电路课程设计，课题：八位二进制并行加法器的实现，包含代码和流程图以及基本说明

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其他  本文的电子密码锁利用数字逻辑电路

本文的电子密码锁利用数字逻辑电路，实现对门的电子控制，并且有各种附加电路保证电路能够安工作，有极高的安全系数。

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嵌入式/单片机编程  数字电子课程设计报告,题目一:三态逻辑电平测试器电路的设计题目二:分压式工作点稳定电路Multisim仿真内附详细的设计原理及原理图

数字电子课程设计报告,题目一:三态逻辑电平测试器电路的设计题目二:分压式工作点稳定电路Multisim仿真内附详细的设计原理及原理图

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嵌入式/单片机编程  拔河游戏机制作的原理图PCB原理图。数字逻辑电路。

拔河游戏机制作的原理图PCB原理图。数字逻辑电路。

https://www.eeworm.com/dl/647/407909.html

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VHDL/FPGA/Verilog 几个简单数字逻辑电路的VHDL代码

几个简单数字逻辑电路的VHDL代码，带有简单的说明

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单片机开发  本文的电子密码锁利用数字逻辑电路

本文的电子密码锁利用数字逻辑电路，实现对门的电子控制，并且有各种附加电路保证电路能够安工作，有极高的安全系数

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