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数值算法/人工智能 全国大学生数学建模竞赛 锁具装箱程序
全国大学生数学建模竞赛 锁具装箱程序
系统设计方案 2008全国大学生数学建模竞赛江苏省一等奖论文
2008全国大学生数学建模竞赛江苏省一等奖论文
VHDL/FPGA/Verilog EDA实验--UART串口实验：UART 主要有由数据总线接口、控制逻辑、波特率发生器、发送部分和接收部分等组成。UART 发送器 --- 发送器每隔16 个CLK16 时钟周期输出1 位
EDA实验--UART串口实验：UART 主要有由数据总线接口、控制逻辑、波特率发生器、发送部分和接收部分等组成。UART 发送器
--- 发送器每隔16 个CLK16 时钟周期输出1 位，次序遵循1位起始位、8位数据位（假定数据位为8位）、1位校验位（可选）、1位停止位。
UART 接收器
--- 串行数据帧和接收时钟是异步的，发送来的数据由逻 ...
VHDL/FPGA/Verilog 四位计数器 计数器是数字系统中用得较多的基本逻辑器件。它不仅能记录输入时钟脉冲的个数
四位计数器
计数器是数字系统中用得较多的基本逻辑器件。它不仅能记录输入时钟脉冲的个数，还可以实现分频、定时、产生节拍脉冲和脉冲序列等。例如，计算机中的时序发生器、分频器、指令计数器等都要使用计数器。
VHDL/FPGA/Verilog 本代码可做为可编程逻辑器件ATF16V8B参考的例子
本代码可做为可编程逻辑器件ATF16V8B参考的例子，实现了各种 与或非逻辑
认证考试资料 MasteringUMLwithRationalRose Rose数据库建模资料
MasteringUMLwithRationalRose Rose数据库建模资料，
单片机开发 逻辑加密卡SLE4442的操作C51函数
逻辑加密卡SLE4442的操作C51函数，包含复位响应、密码比较、读写等操作。
软件工程 uml建模,图书租赁系统的建模,自己完成,可以帮到人就好了
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文章/文档 关于Mulitis 仿真和编程的的逻辑综合
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VHDL/FPGA/Verilog Quartus II关于使用外部逻辑分析器进行系统级调试的说明文档。
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