搜索结果
找到约 15,532 项符合
超前进位加法器 的查询结果
按分类筛选
其他 基本模型机的设计—不带进位与或运算指令的实现
基本模型机的设计—不带进位与或运算指令的实现
其他 这是个简单的DELPHI加法器程序
这是个简单的DELPHI加法器程序,其中用了LABEL部件,BUTTON部件,EDIT部件,初学者可以看看。
VHDL/FPGA/Verilog 这是一种描述加法器的VHDL描述。已经试用过。
这是一种描述加法器的VHDL描述。已经试用过。
其他 里面包含了多个verilog源代码例子 包括循环码编解码、加法器等等常用的例子
里面包含了多个verilog源代码例子 包括循环码编解码、加法器等等常用的例子
单片机开发 步进电机加减速运行程序 步进电机启动时
步进电机加减速运行程序 步进电机启动时,转速由慢到快逐步加速。 步进电机匀速运行 步进电机由快到慢逐步减速到停止
其他 进位制转换;实现10to2、8、16和2、8、16to10.
进位制转换;实现10to2、8、16和2、8、16to10.
系统设计方案 已完成功能 1.完成秒/分/时的依次显示并正确计数; 2.秒/分/时各段个位满10正确进位
已完成功能
1.完成秒/分/时的依次显示并正确计数;
2.秒/分/时各段个位满10正确进位,秒/分能做到满60向前进位;
3.定时闹钟:实现整点报时,又扬声器发出报时声音;
4.时间设置,也就是手动调时功能:当认为时钟不准确时,可以分别对分/时钟进行调整; ...
Windows Mobile Windows Mobile经典手机软件开发源码,加法器源码
Windows Mobile经典手机软件开发源码,加法器源码
VHDL/FPGA/Verilog 在FPGA实现的加法器实现的Veilog代码
在FPGA实现的加法器实现的Veilog代码,应用软件为赛林思公司的ISE9.1
书籍源码 加法器的V代码,这个源代码已经经过严格的检查
加法器的V代码,这个源代码已经经过严格的检查,没有任何问题