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VHDL/FPGA/Verilog 这是个vhdl编写的16bit的加减法器
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软件设计/软件工程 这是一个关于NIOS2嵌入式CPU,尜加UART的技术文档,对天SOPC BUILDER认识的人一看就明白啦.
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驱动编程 WMD驱动编程,本人收集整理的10多个例子和编程环境配置文档,特别是8139驱动,加了许多说明,并测试通过.
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加密解密 毕业设计,md5在linux下的性能测试,加了linux下的时间测试函数!当然也可以加密解密!
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其他 加性高斯白噪声信道下
加性高斯白噪声信道下，OFDM系统仿真程序，调制方式为16QAM
数据结构 C++经典大整数实现,加减乘除.输入输出
C++经典大整数实现,加减乘除.输入输出
VHDL/FPGA/Verilog 这是本人写的可显示128*64LCD全屏汉字的程序,直接下到片子里即可出现象(需自己定制ROM).想显示第二屏的话只需加一个状态即可.
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Java编程 java实现windows托盘（加载dll）（精简版）
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多国语言处理 好东西望管理员给本人多加几分！每个人上传个文件不容易！
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