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教程资料  基于FPGA＋DDS的MSK数字调制源设计

基于FPGA＋DDS的MSK数字调制源设计通信中的DDS技术应用

https://www.eeworm.com/dl/fpga/doc/18452.html

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教程资料  介绍用FPGA设计实现MIL-STD1553B部接口中的曼彻斯特码编解码器

介绍用FPGA设计实现MIL-STD1553B部接口中的曼彻斯特码编解码器

https://www.eeworm.com/dl/fpga/doc/18472.html

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教程资料  用Verilog实现基于FPGA的通用分频器

用Verilog实现基于FPGA的通用分频器

https://www.eeworm.com/dl/fpga/doc/18476.html

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教程资料  使8051能访问整个128KB的RAM空间和128KB的FlashRom空间,在CPLD内建两个寄存器\r\n

8051工作于11.0592MHZ,RAM扩展为128KB的628128,FlashRom扩展为128KB的AT29C010A\r\n 128KB的RAM分成4个区(Bank) 地址分配为0x0000-0x7FFF\r\n 128KB的FlashRom分成8个区(Bank) 地址分配为0x8000-0xBFFF\r\n 为了使8051能访问整个128KB的RAM空间和128KB的FlashRom空间,在CPLD内建两个寄存器\r\n RamBankReg和FlashRomBankReg ...

https://www.eeworm.com/dl/Protel/doc/18497.html

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教程资料  分频器 FPGＡ程序设计　二分频

分频器 FPGＡ程序设计　二分频　对硬件设计有很大用处\r\n

https://www.eeworm.com/dl/fpga/doc/18501.html

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教程资料  采用FPGA模拟高动态GPS信号源中的C／A码产生器

本文：采用了FPGA方法来模拟高动态(Global Position System GPS)信号源中的C／A码产生器。C／A码在GPS中实现分址、卫星信号粗捕和精码(P码)引导捕获起着重要的作用，通过硬件描述语言VERILOG在ISE中实现电路生成，采用MODELSIM、SYNPLIFY工具分别进行仿真和综合。 ...

https://www.eeworm.com/dl/fpga/doc/18520.html

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教程资料  脉冲压缩技术是指对雷达发射的宽脉冲信号进行调制(如线性调频、非线性调频、相位编码)

脉冲压缩技术是指对雷达发射的宽脉冲信号进行调制(如线性调频、非线性调频、相位编码)，并在接收端对回波宽脉冲信号进行脉冲压缩处理后得到窄脉冲的实现过程。脉冲压缩有效地解决了雷达作用距离与距离分辨率之间的矛盾，可以在保证雷达在一定作用距离下提高距离分辨率。\r\n ...

https://www.eeworm.com/dl/fpga/doc/18523.html

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教程资料  基于fpga的JPEG编解码器设计

基于fpga的JPEG编解码器设计，采用流水线优化解决时间并行性问题，提高DCT/IDCT模块的运行速度。

https://www.eeworm.com/dl/fpga/doc/18546.html

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教程资料  用CPLD控制曼彻斯特编解码器

用CPLD控制曼彻斯特编解码器，很详细的文字说明。

https://www.eeworm.com/dl/Protel/doc/18569.html

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教程资料  一种用CPLD设计GPS数字通道相关器中C／A码产生嚣的方法

摘要本文介绍了一种用CPLD设计GPS数字通道相关器中C／A码产生嚣的方法，详细分析了设计原理并给出了相应的仿真结果．这种设计方法已在我们研制的GPS，GLONASS兼容机中得到实际应用。

https://www.eeworm.com/dl/Protel/doc/18587.html

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