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译码器设计 的查询结果
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这是一个HDB3的译码器，实现从HDB3双极性码到高低电平二值序列的转化
VHDL/FPGA/Verilog 这是一个HDB3的译码器
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VHDL/FPGA/Verilog 分别用分频比交错法及累加器分频法完成非整数分频器设计。
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单片机开发 单片机智能抢答器设计论文
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VHDL/FPGA/Verilog 用vhdl 语言实现138译码器
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文章/文档 一种基于turbo码的交织器设计
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LDPC 译码器
function [vhat]=decode_ldpc(rx_waveform,No,amp,h,scale)
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VHDL/FPGA/Verilog decoder3_8实现了FPGA或CPLD 实现3-8译码器的功能
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