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译码器设计 的查询结果
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教程资料 基于FPGA的RS码译码器的设计
介绍了符合CCSDS标准的RS（255，223）码译码器的硬件实现结构。译码器采用8位并行时域译码算法，主要包括了修正后的无逆BM迭代译码算法，钱搜索算法和Forney算法。采用了三级流水线结构实现，减小了译码器的时延，提高了译码的速率，使用了VHDL语言完成译码器的设计与实现。测试表明，该译码器性能优良，适用于高速通信。
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教程资料 LTE标准下Turbo码编译码器的集成设计
针对固定码长Turbo码适应性差的缺点，以LTE为应用背景，提出了一种帧长可配置的Turbo编译码器的FPGA实现方案。该设计可以依据具体的信道环境和速率要求调节信息帧长，平衡译码性能和系统时延。方案采用“自顶向下”的设计思想和“自底而上”的实现方法，对 Turbo编译码系统模块化设计后优化统一，经时序仿真验证后下载配置 ...
可编程逻辑 基于FPGA的RS码译码器的设计
介绍了符合CCSDS标准的RS（255，223）码译码器的硬件实现结构。译码器采用8位并行时域译码算法，主要包括了修正后的无逆BM迭代译码算法，钱搜索算法和Forney算法。采用了三级流水线结构实现，减小了译码器的时延，提高了译码的速率，使用了VHDL语言完成译码器的设计与实现。测试表明，该译码器性能优良，适用于高速通信。
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可编程逻辑 LTE标准下Turbo码编译码器的集成设计
针对固定码长Turbo码适应性差的缺点，以LTE为应用背景，提出了一种帧长可配置的Turbo编译码器的FPGA实现方案。该设计可以依据具体的信道环境和速率要求调节信息帧长，平衡译码性能和系统时延。方案采用“自顶向下”的设计思想和“自底而上”的实现方法，对 Turbo编译码系统模块化设计后优化统一，经时序仿真验证后下载配置 ...
数据结构 这是一个有关哈夫曼编/译码器的课程设计
这是一个有关哈夫曼编/译码器的课程设计， 原题参见青华大学出版社出版、严巍敏主编的数据结构题集（c语言版）
VHDL/FPGA/Verilog 7段数码显示译码器图形设计.doc!!!需要的快下哦
7段数码显示译码器图形设计.doc!!!需要的快下哦
其他 本次设计的具有6种花型循环变化的彩灯控制器就是用计数器和译码器来实现
本次设计的具有6种花型循环变化的彩灯控制器就是用计数器和译码器来实现，其特点用双色发光二极管，能发红色和绿色两色光。
单片机开发 3-8译码器学校课程设计上载以大家共享
3-8译码器学校课程设计上载以大家共享，如有不足请多指教
VHDL/FPGA/Verilog 循环纠错码译码器VHDL代码。通信方面FPGA设计基础代码。
循环纠错码译码器VHDL代码。通信方面FPGA设计基础代码。
汇编语言 用VHDL设计的3-8译码器
用VHDL设计的3-8译码器，精简~！