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译码器设计 的查询结果
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VHDL/FPGA/Verilog cpld/fpga RS(204,188)译码器的verilog程序
cpld/fpga RS(204,188)译码器的verilog程序
企业管理 学生成绩管理器设计,学生成绩管理器设计
学生成绩管理器设计,学生成绩管理器设计
VHDL/FPGA/Verilog 程序提供了一种高效简单的38译码器的算法
程序提供了一种高效简单的38译码器的算法，非常实用
VHDL/FPGA/Verilog vhdl的七段译码器
vhdl的七段译码器
VHDL/FPGA/Verilog 用vhdl语言编写译码器
用vhdl语言编写译码器，呵呵，希望有所帮助
微处理器开发 基于STM32的MP3播放器设计与实现 MDK完整源码 原文 http://blog.ednchina.com/xiong_gang_whut/140556/message.aspx
基于STM32的MP3播放器设计与实现 MDK完整源码
原文
http://blog.ednchina.com/xiong_gang_whut/140556/message.aspx
软件设计/软件工程 AML7228硬盘RM播放器设计参考(相关编程手册)。
AML7228硬盘RM播放器设计参考(相关编程手册)。
单片机开发 基于LED点阵显示屏9路抢答器设计
基于LED点阵显示屏9路抢答器设计，内容丰富，功能不错。
VHDL/FPGA/Verilog 3-8译码器的仿真实验。本实验选用的仿真开发软件是MAX+plus II Version 9.3
3-8译码器的仿真实验。本实验选用的仿真开发软件是MAX+plus II Version 9.3，原理图源文件保存在MyProject目录中，为138decoder.gdf，另有我写的实验报告，呵呵，适合仿真入门
数据结构 哈夫曼编/译码器:利用哈夫曼编码进行通信可以大大提高信道利用率
哈夫曼编/译码器:利用哈夫曼编码进行通信可以大大提高信道利用率，缩短信息传输入时间，
降低成本，但是，这要求发送端通过一个编码系统对待传输数据先进行编码，在
接收端将传来的数据进行译码。对于双工信道（可双向传输的信道），每端都需
要一个完整的编/译码系统。 ...