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VHDL/FPGA/Verilog 为了减轻大家负担

为了减轻大家负担，在次把带进位输入的8位加法计数器上传，希望能出分；力

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VHDL/FPGA/Verilog 为了给大家紧张的工作减轻点负担

为了给大家紧张的工作减轻点负担，我把带进位输入的8位加法计数器上传在此，希望大家支持

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单片机开发  keil c语言

keil c语言，实现计数器功能。适合初学者应用

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单片机开发  电子闹钟 clk：标准时钟信号

电子闹钟 clk：标准时钟信号，本例中，其频率为4Hz； clk_1k：产生闹铃音、报时音的时钟信号，本例中其频率为1024Hz； mode：功能控制信号；为0：计时功能；为1：闹钟功能；为2：手动校时功能； turn：接按键，在手动校时功能时，选择是调整小时，还是分钟；若长时间按住该键，还可使秒信号清零，用于精确调时； c ...

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VHDL/FPGA/Verilog 数控分频器的设计数控分频器的功能就是当在输入端给定不同输入数据时

数控分频器的设计数控分频器的功能就是当在输入端给定不同输入数据时，将对输入的时钟信号有不同的分频比，例3的数控分频器就是用计数值可并行预置的加法计数器设计完成的，方法是将计数溢出位与预置数加载输入信号相接即可。 ...

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单片机开发  基于89s52的c51串口通信源程序串口的4种工作方式对应着三种波特率模式：对于工作在方式1和方式3

基于89s52的c51串口通信源程序串口的4种工作方式对应着三种波特率模式：对于工作在方式1和方式3，波特率由定时器/计数器1T1的溢出率和SMOD（PCON（电源控制寄存器）D7位）决定，

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其他  数字钟是一个将“时”“分”“秒”显示于人的视觉器官的计时装置。它的计时周期为24小时；显示满刻度为23时59分59秒

数字钟是一个将“时”“分”“秒”显示于人的视觉器官的计时装置。它的计时周期为24小时；显示满刻度为23时59分59秒，另外具备校时功能和报时功能。因此，一个基本的数字钟电路主要由“时”“分”“秒”计数器校时电路组成。将标准秒信号送入“秒计数器”，“秒计数器”采用60进制计数器，每累加60秒发送一个“分脉冲”信号 ...

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单片机开发  采用两个定时器合用

采用两个定时器合用，T0设置为定时方式，T1设置为计数方式。T0定时时间为50ms，计满产生的输出信号由P1.7口发光二极管显示。同时还将该信号输入到计数器T1（P3.5脚）作为T1的计数输入脉冲，当输入信号产生由1到0的跳变时触发计数器工作,使计数器的值增1。计数器T1的初始值设置为100，计满时所用的时间为50ms×2×100，即10s ...

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VHDL/FPGA/Verilog 完成一个加速器设计

完成一个加速器设计，全加器，具 8位计数器

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单片机开发  红外在单片机上的应用,C语言源码,Keil uVision3工程文件,附原理图及说明学习文档红外接收电路采用集成红外接收器成品H1

红外在单片机上的应用,C语言源码,Keil uVision3工程文件,附原理图及说明学习文档红外接收电路采用集成红外接收器成品H1，接收器包括红外接收管和信号处理IC，均集成在红外接收器H1内。接收器对外只有3个引脚：Vcc、GND和一个脉冲信号输出PO。Vcc接系统的电源正极（+5V），GND接系统的地线，脉冲信号输出接CPU的中断输入引 ...

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