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Java编程 具有代表性的示例,是初学java编程者不错的选择.
具有代表性的示例,是初学java编程者不错的选择.
VHDL/FPGA/Verilog SRL16是Virtex器件中的一个移位寄存器查找表。它有4个输入用来选择输出序列的长度。使用XCV50-6器件实现
SRL16是Virtex器件中的一个移位寄存器查找表。它有4个输入用来选择输出序列的长度。使用XCV50-6器件实现，共占用5个Slice。用来生成gold码。
FlashMX/Flex源码 很酷的3D相册,可以用鼠标来自由旋转和放大缩小,不妨下载看看~!
很酷的3D相册,可以用鼠标来自由旋转和放大缩小,不妨下载看看~!
企业管理 第一章绪论 5 1.1课题来源 5 1.2 开发工具的选择 5 1.3 本文所做工作 6 第二章 需求分析 7 2.1 总体需求调查 7 2.1.1 组织结构图 7 2.1.2 系统目标
第一章绪论 5
1.1课题来源 5
1.2 开发工具的选择 5
1.3 本文所做工作 6
第二章 需求分析 7
2.1 总体需求调查 7
2.1.1 组织结构图 7
2.1.2 系统目标 7
2.1.3 应用现状调查 7
2.1.4业务总体流程调查 8
2.2系统功能调查 9
2.2.1系统维护功能 9
2.3系统功能模块图 9
第三章 概要设计 10
3.1概念设计 10
3.2数据库设计 11
3.2.1 ...
人工智能/神经网络 路由选择过程的c算法程序 与DSR 只是简单地使用最短路径不同
路由选择过程的c算法程序
与DSR 只是简单地使用最短路径不同，EMRPC 使用了更复杂的路由选择机制以实现多径路由和能量均衡。
家庭/个人应用 从“闹钟时”下拉框选择要闹铃的小时(0-23)
从“闹钟时”下拉框选择要闹铃的小时(0-23)，从“闹钟分”下拉框选择要闹铃的分钟。当闹铃时间前1分钟会弹出一个提醒窗口，持续闹铃3分钟。如果不想听了可以把提醒窗口关掉。如果不想设置而不小心又点了下拉框，可点击“不设置”。当小时设置在上午时间段，听到的是女声“宝贝，快起床了”，其他听到的则是狼叫声，呵呵。 ...
VHDL/FPGA/Verilog 微波炉定时器集成电路的设计 1、 控制状态机：工作状态状态转换。 2、 数据装入电路：根据控制信号选择定时时间、测试数据或完成信号的装入。 3、 定时器电路：负责完成烹调过程中的时间递减计
微波炉定时器集成电路的设计 1、 控制状态机：工作状态状态转换。
2、 数据装入电路：根据控制信号选择定时时间、测试数据或完成信号的装入。
3、 定时器电路：负责完成烹调过程中的时间递减计数和数据译码供给七段数码显示，同时还可以提供烹调完成时间的状态信号供控制状态机产生完成信号。 ...
汇编语言 设计要求：编写程序实现利用定时器演奏乐曲。本程序通过调用通用GENSOUND程序发出各种声音演奏乐曲。选择p播放音乐“太湖船”
设计要求：编写程序实现利用定时器演奏乐曲。本程序通过调用通用GENSOUND程序发出各种声音演奏乐曲。选择p播放音乐“太湖船”，选择q退出。
单片机开发 8253的初始化程序举例: 例1：选择2号计数器
8253的初始化程序举例:
例1：选择2号计数器，工作在3方式，计数初值为533H（2个字节），采用二进制计数。其初始化程序段为
MOV DX，307H ；命令口
MOV AL，10110110B ；2号计数器的初始化命 令字
OUT DX，AL ；写入命令寄存器
MOV DX，306H ；2号计数器数据口
MOV AX，533H ；计数初值
OUT DX，AL ；选送低字节到2号 ...
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