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其他  数据绑定采用GridView控件

数据绑定采用GridView控件，发布留言时支持头像选择 App_Data/book.mdb为Access数据库文件后台入口登陆采用彩色验证码进行校验并支持Ajax无刷新变换，登陆地址：/RoleByAccess/adminlogin.aspx 用户名：51aspx 密码：51aspx

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VHDL/FPGA/Verilog 用FPGA实现了RS232异步串行通信

用FPGA实现了RS232异步串行通信，所用语言是VHDL，另外本人还有Verilog的欢迎交流学习，根据RS232 异步串行通信来的帧格式，在FPGA发送模块中采用的每一帧格式为：1位开始位+8位数据位+1位奇校验位+1位停止位，波特率为2400。由设置的波特率可以算出分频系数，具体算法为分频系数X=CLK/(BOUND*2)。 ...

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其他  SDL Component suite for D6 SDL 组建是一套支持科学和工程计算的工业控件集

SDL Component suite for D6 SDL 组建是一套支持科学和工程计算的工业控件集，有10万行源码，50个例程. 3D 数据， 3D 数据，地图集，原子符号，β函数的情节的旋转，校验扫描的图像， CAS 登记号码，图表，颜色选择，常量和兑换率，轮廓绘制，化学结构，化学数据，化学公式，Ｘ分配，群聚，转换程序，曲线适合，地理数据 ...

https://www.eeworm.com/dl/534/320683.html

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VHDL/FPGA/Verilog EDA实验--UART串口实验：UART 主要有由数据总线接口、控制逻辑、波特率发生器、发送部分和接收部分等组成。UART 发送器 --- 发送器每隔16 个CLK16 时钟周期输出1 位

EDA实验--UART串口实验：UART 主要有由数据总线接口、控制逻辑、波特率发生器、发送部分和接收部分等组成。UART 发送器 --- 发送器每隔16 个CLK16 时钟周期输出1 位，次序遵循1位起始位、8位数据位（假定数据位为8位）、1位校验位（可选）、1位停止位。 UART 接收器 --- 串行数据帧和接收时钟是异步的，发送来的数据由逻 ...

https://www.eeworm.com/dl/663/320690.html

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SDL Component suite for D6 SDL 组建是一套支持科学和工程计算的工业控件集，有10万行源码，50个例程. 3D 数据， 3D 数据，地图集，原子符号，β函数的情节的旋转，校验扫描的图像， CAS 登记号码，图表，颜色选择，常量和兑换率，轮廓绘制，化学结构，化学数据，化学公式，Ｘ分配，群聚，转换程序，曲线适合，地理数据 ...

https://www.eeworm.com/dl/534/320691.html

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加密解密  将文件隐藏于位图

将文件隐藏于位图，加密，CRC校验，数字水印

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其他  　在远距离数据通信中

　在远距离数据通信中，为确保高效而无差错地传送数据，必须对数据进行校验即差错控制。循环冗余校验CRC(Cyclic Redundancy Check)是对一个传送数据块进行校验，

https://www.eeworm.com/dl/534/322033.html

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嵌入式Linux winbond w90n745串口驱动

winbond w90n745串口驱动，修正原BSP包中无奇偶校验问题

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VHDL/FPGA/Verilog EDA实验--UART串口实验：UART 主要有由数据总线接口、控制逻辑、波特率发生器、发送部分和接收部分等组成。UART 发送器 --- 发送器每隔16 个CLK16 时钟周期输出1 位

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