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Java编程 Jfreechart 源码例子 是和jfreechart development Guide文档相配套的
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微处理器开发 IDE.C,ZLG/GF驱动主文件;IDE.H,ZLG/GF主文件相关头文件;SYSATA.C,ZLG/CF驱动的接口文件 SYSATA.C,ZLG/CF驱动的接口文件的头文件。
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汇编语言 基于单片机的锁相频率合成器的设计:MC145151-2芯片
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VHDL/FPGA/Verilog 二分频的实现 二分频的作用是将测相范围由0°~180°扩大到0°~360°。
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文章/文档 锁相环路是一种能够跟踪输入信号相位的闭环自动控制系统。随着信息科学和电子技术的迅速发展
锁相环路是一种能够跟踪输入信号相位的闭环自动控制系统。随着信息科学和电子技术的迅速发展,锁相环路在电子技术的各个领域得到了广泛的应用。
VHDL/FPGA/Verilog 数字锁相环(DPLL)技术在数字通信、无线电电子学等众多领域得到了极为广泛的应用。与传统的模拟电路实现的PLL相比
数字锁相环(DPLL)技术在数字通信、无线电电子学等众多领域得到了极为广泛的应用。与传统的模拟电路实现的PLL相比,DPLL具有精度高、不受温度和电压影响、环路带宽和中心频率编程可调、易于构建高阶锁相环等优点。
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