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学术论文 基于FPGA的RS255,223编解码器的高速并行实现.rar

随着信息时代的到来,用户对数据保护和传输可靠性的要求也在不断提高。由于信道衰落,信号经信道传输后,到达接收端不可避免地会受到干扰而出现信号失真。因此需要采用差错控制技术来检测和纠正由信道失真引起的信息传输错误。RS(Reed—Solomon)码是差错控制领域中一类重要的线性分组码,由于它编解码结构相对固定,性能 ...
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学术论文 JPEG编解码的FPGA仿真研究.rar

随着图像声纳技术的发展,对于大数据量图像数据的压缩成为必须要解决的一个课题。本文结合水声图像特点,应用VerilogHDL 语言在Quartus Ⅱ软件环境下设计实现了JPEG基本模式编解码器。 JPEG是国际标准化组织(ISO)和CCITT 联合制定的静态图像的压缩标准,是目前最常使用的图像存储格式。 论文首先介绍了JPEG编码的基本原理, ...
https://www.eeworm.com/dl/514/9200.html
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学术论文 MP3音频编解码运算中IMDCT算法研究及其FPGA实现.rar

近年来,随着多媒体技术的迅猛发展,电子、计算机、通讯和娱乐之间的相互融合、渗透越来越多,而数字音频技术则是应用最为广泛的技术之一。MP3(MPEG-1 Audio LayerⅢ)编解码算法作为数字音频的解决方案,在便携式多媒体产品中得到了广泛流行。 在已有的便携式MP3系统实现方案中,低速处理器与专用硬件结合的SOC设计方案结合 ...
https://www.eeworm.com/dl/514/9432.html
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学术论文 基于H.264编解码的算法优化研究及FPGA的硬件实现.rar

H.264/AVC是由ITU和ISO两大组织联合组成的JVT共同制定的一项新的视频压缩技术标准,在较低带宽上提供高质量的图像传输是H.264/AVC的应用亮点。在同样的视觉质量前提下,H.264/AVC比H.263和MPEG-4节约了50%的码率。但H.264获得优越性能的代价是计算复杂度的增加,据估计其编码的计算复杂度大约为H.263的3倍,因此很难应用于 ...
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学术论文 图象压缩系统中熵编解码器的FPGA设计及实现

随着移动终端、多媒体、Internet网络、通信,图像扫描技术的发展,以及人们对图象分辨率,质量要求的不断提高,用软件压缩难以达到实时性要求,而且会带来因传输大量原始图象数据带来的带宽要求,因此采用硬件实现图象压缩已成为一种必然趋势。而熵编码单元作为图像变换,量化后的处理环节,是图像压缩中必不可少的部分。研 ...
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学术论文 IEEE 802.16a RS-CC编译码VLSI算法研究及FPGA实现

  本论文依据IEEE802.16a物理层对RS-CC码的参数要求,研究了RS-CC码的高速编、译码的VLSI硬件算法,同时对FPGA开发技术进行了研究,以VerilogHDL为描述语言,在Xilinx公司的FPGA上实现了高速的RS-CC编、译码器。RS译码器中,错误位置多项式和错误值多项式的求解采用无求逆单元,并具有规则数据流、易于VLSI实现的改进的欧 ...
https://www.eeworm.com/dl/514/10057.html
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学术论文 H.264高清视频编解码系统中ARM控制模块的软件设计.pdf

随着数字电视日益深入人心,高清概念越来越为人所熟知。带有高清视频功能的产品已经逐步走向人们的工作和生活,高清视频处理已经从理论研究走向系统实际应用。毫无疑问,无论是从观众的视觉还是从产业的角度来看,高清视频已经成为数字视频技术发展的必然趋势。本文研究了整个编解码系统中ARM控制模块的软件设计,最终完成 ...
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学术论文 基于ARM的H264编解码实现

由国际电信联合会视频编码专家组和国际化标准组织运动图像专家组联合制定的H.264视频压缩标准,凭借相对其它标准较高的压缩效率和优秀的图像质量,已经成为目前最流行的视频处理协议,具有广阔的前景和巨大的应用价值,考虑其复杂的计算度,目前主流的实现方式包括ASIC的专用集成电路实现和DSP的纯软件实现等等。 ARM处理器 ...
https://www.eeworm.com/dl/514/11549.html
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学术论文 DVBT信道编解码算法研究及FPGA实现

数字通信系统中,在实际信道上传输数字信号时,由于信道传输特性不理想及噪声的影响,接收端所收到的数字信号不可避免地会发生错误。为了减小误码率,提高接收质量,必须采用差错控制编码。对于数字视频通信系统这类高码率,高要求的系统,为了提供优良的图象质量,采用差错控制编码尤为重要。 本文采用的DVB-T系统差错控制 ...
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学术论文 DVB系统中RS编解码器的FPGA实现

该论文讨论如何采用一种串行无逆的Berlekamp-Massey(BM)算法,设计应用于DVB系统中的RS(204,188)信道编码/解码电路,并通过FPGA的验证.RS解码器的设计采用无逆BM算法,并利用串行方式来实现,不仅避免了求逆运算,而且只需用3个有限域乘法器就可以实现,大大的降低了硬件实现的复杂度,并且因为在硬件实现上,采用了3级流水线(pipe- ...
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