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系统设计方案  介绍MT9V011 CMOS数字图像传感器在一个基于低端ARM7处理器和CPLD(可编程逻辑器件)的嵌入式系统中的应用。通过一片CPLD读取MT9V011采集的图像并缓存到存储器以备后续的处理。利用P

介绍MT9V011 CMOS数字图像传感器在一个基于低端ARM7处理器和CPLD(可编程逻辑器件)的嵌入式系统中的应用。通过一片CPLD读取MT9V011采集的图像并缓存到存储器以备后续的处理。利用PC平台验证了图像采集功能。给出了一个在低端嵌入式系统中增加图像采集功能的实现方案。 ...

https://www.eeworm.com/dl/678/337115.html

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Java编程  对XML和DB的CURD的基本操作.使用的两个比较常用的组合设计模式：MVC模式+DAO模式。

对XML和DB的CURD的基本操作.使用的两个比较常用的组合设计模式：MVC模式+DAO模式。

https://www.eeworm.com/dl/633/337782.html

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其他  当前大多数模糊系统的推理机都是以交规则的形式出现,随着输入的增加,规则的数目将呈指数增长,出现了规则组合爆炸的问题。采用并规则设计的一种模糊PID控制器,解决了规则爆炸的问题,同时改善了系统的动态性能

当前大多数模糊系统的推理机都是以交规则的形式出现,随着输入的增加,规则的数目将呈指数增长,出现了规则组合爆炸的问题。采用并规则设计的一种模糊PID控制器,解决了规则爆炸的问题,同时改善了系统的动态性能和实时性。

https://www.eeworm.com/dl/534/338165.html

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其他行业  配电网重构是一个多目标、多时段、多组合、多约束的非线性优化问题。该问题的复杂性

配电网重构是一个多目标、多时段、多组合、多约束的非线性优化问题。该问题的复杂性，决定了难以用单纯的数学方法得到满意的解。尝试用改进的遗传算法进行配电网络重构，建立评价函数，寻求该评价函数最优解

https://www.eeworm.com/dl/668/338515.html

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VHDL/FPGA/Verilog 郑亚民版的可编程逻辑器件开发软件quatus ii里的一些例程

郑亚民版的可编程逻辑器件开发软件quatus ii里的一些例程，对初学者很有帮助。

https://www.eeworm.com/dl/663/338629.html

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VHDL/FPGA/Verilog FPGA逻辑设计

FPGA逻辑设计，vhdl/verilog altera/xilinx 介绍

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数学计算  统计英文字母字母组合出现的频率

统计英文字母字母组合出现的频率，并有较为详细的模型。

https://www.eeworm.com/dl/641/339802.html

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人工智能/神经网络  在软件接收机的基础上,利用鉴频器辅助鉴相器的输出,引入一个模糊逻辑控制器,使得环路能够智能跟踪信号的动态变化.实验结果证明所提出的设计方法与传统环路相比可大幅度缩短跟踪时间,减小环路滤波器带宽,并能消

在软件接收机的基础上,利用鉴频器辅助鉴相器的输出,引入一个模糊逻辑控制器,使得环路能够智能跟踪信号的动态变化.实验结果证明所提出的设计方法与传统环路相比可大幅度缩短跟踪时间,减小环路滤波器带宽,并能消除周跳.

https://www.eeworm.com/dl/650/340579.html

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JavaScript javascript实现一个高级组合查询控件

javascript实现一个高级组合查询控件

https://www.eeworm.com/dl/685/340989.html

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VHDL/FPGA/Verilog VHDL硬件描述语言与数字逻辑电路设计,学习VHDL的好资料

VHDL硬件描述语言与数字逻辑电路设计,学习VHDL的好资料

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