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组合逻辑 的查询结果
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文章/文档 基本算法正稿 包括:一、数论算法;二、图论算法;三、背包问题;四、排序算法;五、高精度计算;六、 树的遍历;七 进制转换;八 全排列与组合的生成;九.查找算法;十、贪心;十一、回溯法框架;十二、DF
基本算法正稿
包括:一、数论算法;二、图论算法;三、背包问题;四、排序算法;五、高精度计算;六、 树的遍历;七 进制转换;八 全排列与组合的生成;九.查找算法;十、贪心;十一、回溯法框架;十二、DFS框架;十三、BFS框架;十五、数据结构相关算法 ...
交通/航空行业 简单的泊车程序,数据结构课程的实验.理解栈和队列的逻辑结构和存储结构
简单的泊车程序,数据结构课程的实验.理解栈和队列的逻辑结构和存储结构,进一步提高使用理论知识指导解决实际问题的能力。
嵌入式/单片机编程 基于复杂可编程逻辑器件(CPLD)的120MHz高速A_D采集卡的设计
基于复杂可编程逻辑器件(CPLD)的120MHz高速A_D采集卡的设计
其他 ewb仿真 数字逻辑课程设计 使用电脑EWB仿真技术
ewb仿真 数字逻辑课程设计 使用电脑EWB仿真技术,独立完整地设计一定功能的电子电路
数据结构 稀疏矩阵运算器 以“带行逻辑链接信息”的三元组顺序表表示稀疏矩阵
稀疏矩阵运算器 以“带行逻辑链接信息”的三元组顺序表表示稀疏矩阵
编译器/解释器 7段数码是纯组合电路
7段数码是纯组合电路,通常的小规模专用IC,如74或4000系列的器件只能作十进制BCD码译码,然而数字系统中的数据处理和运算都是2进制的,所以输出表达都是16进制的,为了满足16进制数的译码显示,最方便的方法就是利用VHDL译码程序在FPGA或CPLD中实现。本项实验很容易实现这一目的。例6-1作为7段BCD码译码器的设计,输出信号 ...
嵌入式/单片机编程 译码器的逻辑功能是将已赋予特定含义的一组二进制输入代码的原意"翻译"出来,变成对应的输出高低电平信号.该程序为3-8译码器.基于VHDL,其开发环境是MAXPLUS2.
译码器的逻辑功能是将已赋予特定含义的一组二进制输入代码的原意"翻译"出来,变成对应的输出高低电平信号.该程序为3-8译码器.基于VHDL,其开发环境是MAXPLUS2.
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VHDL硬件描述语言与数字逻辑电路设计,需要的朋友可以下载。