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教程资料 基于FPGA的RS码译码器的设计
介绍了符合CCSDS标准的RS（255，223）码译码器的硬件实现结构。译码器采用8位并行时域译码算法，主要包括了修正后的无逆BM迭代译码算法，钱搜索算法和Forney算法。采用了三级流水线结构实现，减小了译码器的时延，提高了译码的速率，使用了VHDL语言完成译码器的设计与实现。测试表明，该译码器性能优良，适用于高速通信。
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教程资料 FPGA DIY拨码开关实验源码下载
FPGA_DIY拨码开关实验源码
教程资料 基于FPGA实现扩频码的捕获
通过对伪码捕获原理进行分析以及对各种捕获方法进行比较,确定一种性能好、易实现的串并混合搜索捕获方案。并给出了一个在实际系统中成功应用的捕获电路,用Modelsim对伪码捕获电路部分模块的性能进行了仿真。
教程资料 LTE标准下Turbo码编译码器的集成设计
针对固定码长Turbo码适应性差的缺点，以LTE为应用背景，提出了一种帧长可配置的Turbo编译码器的FPGA实现方案。该设计可以依据具体的信道环境和速率要求调节信息帧长，平衡译码性能和系统时延。方案采用“自顶向下”的设计思想和“自底而上”的实现方法，对 Turbo编译码系统模块化设计后优化统一，经时序仿真验证后下载配置 ...
通信网络 基于UDP协议的网络文件传输源码
VC 基于UDP协议的网络文件传输源码
通信网络 LDPC码理论分析及仿真研究
LDPC码理论分析及仿真研究
通信网络 一种降低码构造复杂度的QSTBC设计
 本文采用分圆格方法，设计了一种简化型具全分集、满速率特性的四发四收准正交空时分组码。该准正交空时分组码不仅比传统的基于星座调制技术的四发四收准正交空时码具有更大的分集增益上界，而且比已有的八发一收分圆准正交空时码在误码率和信道容量、以及中断概率等方面皆具有显著的优越性。
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通信网络 基于ADS的接收机码元同步算法实现
在数字接收机中，为了在抽样判决时刻准确判决发送过来的码元，需要提供一个确定抽样判决时刻的定时脉冲序列。这个定时脉冲序列的重复频率必须与发送的数码脉冲序列一致（即接收、发送双方必须同步，具有相同的主频率），同时在最佳判决时刻对接收码元进行抽样判决。这样的定时脉冲序列称为码元同步。 ...
通信网络 tcp ip协议详解 中文版PDF
很多不同的厂家生产各种型号的计算机，它们运行完全不同的操作系统，但TCP.IP协议族允许它们互相进行通信。这一点很让人感到吃惊，因为它的作用已远远超出了起初的设想。T C P / I P起源于6 0年代末美国政府资助的一个分组交换网络研究项目，到9 0年代已发展成为计算机之间最常应用的组网形式。它是一个真正的开放系统， ...