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VHDL/FPGA/Verilog altera的timing约束文档

altera的timing约束文档，很有帮助

https://www.eeworm.com/dl/663/311308.html

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汇编语言  无约束优化方法程序考核题

无约束优化方法程序考核题

https://www.eeworm.com/dl/644/312151.html

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压缩解压  图像的编码与压缩从本质上说就是对要处理的图像源数据用一定的规则进行变换和组合

图像的编码与压缩从本质上说就是对要处理的图像源数据用一定的规则进行变换和组合，从而达到以尽可能少的代码（或符号）来表示尽可能多的数据信息的目的。压缩通过编码来实现，或者说编码带来压缩的效果，所以一般把此项处理称之为压缩编码 ...

https://www.eeworm.com/dl/617/312497.html

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人工智能/神经网络  动物识别系统动物识别专家系统按下列规则

动物识别系统动物识别专家系统按下列规则，写出一个分类专家系统：（1）有毛的动物是哺乳类；（2）有奶的动物是哺乳类；（3）有羽毛的动物是鸟类；

https://www.eeworm.com/dl/650/312687.html

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人工智能/神经网络  关联规则挖掘算法 apriori vc下编译通过

关联规则挖掘算法 apriori vc下编译通过

https://www.eeworm.com/dl/650/313075.html

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单片机开发  时钟约束实验

时钟约束实验，在xilinx公司的spartan 3E板上通过控制按钮开关来实现对LED的控制

https://www.eeworm.com/dl/648/313568.html

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VHDL/FPGA/Verilog 以LVDS设计为例学习ISE中的时序分析以及低层布局器的使用方法在底层布局器中对LVDS管脚进行约束的方法

以LVDS设计为例学习ISE中的时序分析以及低层布局器的使用方法在底层布局器中对LVDS管脚进行约束的方法，底层布局器设计流程，底层布局器中的位置约束，时序分析器的使用方法，时序改进向导的使用等.

https://www.eeworm.com/dl/663/314066.html

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其他  模拟一个Petri网的行为:该程序应该读入一组转换规则

模拟一个Petri网的行为:该程序应该读入一组转换规则，以及一组状态列表，这些状态对应与网络链路层发出一个新的分组或者接受一个新的分组。初始状态也是要读入的。该程序应该从初始状态开始，随机地选取那些激活的转换，并激发这些转换，检查一下看是否有“一台主机接受了2个分组而另一台主机并没有在此期间发出新的分组” ...

https://www.eeworm.com/dl/534/314094.html

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人工智能/神经网络  关联规则挖掘算法的设计与实现赫赫 vc下的

关联规则挖掘算法的设计与实现赫赫 vc下的

https://www.eeworm.com/dl/650/314706.html

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数学计算  常用算法程序集(C语言描述)第三版+徐士良不等式约束线性规划问题

常用算法程序集(C语言描述)第三版+徐士良不等式约束线性规划问题

https://www.eeworm.com/dl/641/315775.html

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