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学术论文  基于ZigBee隧道照明无线控制系统研究和设计.rar

高速公路隧道属于特殊路段，隧道洞内外环境差别非常大，需要在隧道内设置电光照明，以消除司机的“暗适应"与“明适应’’视觉问题，保证隧道行车安全。而当前的大部分高速公路隧道照明控制系统简单，照明光源舒适度不高，未根据洞外环境亮度，综合车速车流量及洞内烟雾浓度等因素，实时调节隧道洞内照明亮度，存在盲目加大 ...

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学术论文  基于FPGA的高速采样自适应滤波系统的研究

自适应滤波器的硬件实现一直是自适应信号处理领域研究的热点。随着电子技术的发展，数字系统功能越来越强大，对器件的响应速度也提出更高的要求。本文针对用通用DSP 芯片实现的自适应滤波器处理速度低和用HDL语言编写底层代码用FPGA实现的自适应滤波器开发效率低的缺点，提出了一种基于DSP Builder系统建模的设计方法。以 ...

https://www.eeworm.com/dl/514/9973.html

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学术论文  基于FPGA组的ASIC逻辑验证技术研究

随着ASIC设计规模的增长，功能验证已成为整个开发周期的瓶颈。传统的基于软件模拟和硬件仿真的逻辑验证方法已难以满足应用的要求，基于FPGA组的原型验证方法能有效缩短系统的开发周期，可提供更快更全面的验证。由于FPGA芯片容量的增加跟不上ASIC设计规模的增长，单芯片已无法容纳整个设计，所以常常需要对设计进行逻辑分割 ...

https://www.eeworm.com/dl/514/9977.html

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学术论文  红外成像制导的FPGA数据预处理技术研究

本文研究了在复杂背景下红外图像的背景和噪声抑制算法，并且完成了硬件实现，主要包括以下内容： 1.通过对实际红外图像的背景和噪声特性的研究分析，设计改进了一种基于加权广义次序统计滤波器的背景抑制的算法。红外图像的噪声通常为脉冲噪声，具有高频特性；而红外图像的背景变换比较缓慢，其频谱成分多集中在低频区域， ...

https://www.eeworm.com/dl/514/9980.html

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学术论文  基于FPGA/CPLD实现的FFT算法与仿真分析

可编程逻辑器件FPGA(现场可编程门阵列)和CPLD(复杂可编程逻辑器件)越来越多的应用于数字信号处理领域，与传统的ASIC(专用集成电路)和DSP(数字信号处理器)相比，基于FPGA和CPLD实现的数字信号处理系统具有更高的实时性和可嵌入性，能够方便地实现系统的集成与功能扩展。 FFT的硬件结构主要包括蝶形处理器、存储单元、地址生 ...

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学术论文  ECC密码算法的FPGA实现及优化设计

　　本文主要对基于FPGA芯片的椭圆曲线密码算法的实现及优化设计进行了研究。由于点乘运算极大影响了椭圆曲线密码系统的加/解密速度，本文对点乘运算的FPGA设计进行了重点优化。首先比较分析了三种点乘算法，从运算复杂度的角度确定了蒙哥马里算法是最利于FPGA芯片实现的。然后根据蒙哥马里算法，用VerilogHDL语言实现了基 ...

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学术论文  QPSK基带通信设计及其FPGA实现的研究

　　全数字调制解调技术具有多速率、多制式、智能性等特点，这极大的提高了通信系统的灵活性和通用性，符合未来通信技术发展的方向。　　本文从如下几个方面对全数字调制解调器进行了深入系统研究：1，在介绍全数字调制解调器的发展现状和研究QPSK通信调制解调方式的基础上，依据软件定性仿真分析了QPSK正交调制解调系统， ...

https://www.eeworm.com/dl/514/10002.html

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学术论文  基于运动补偿的去隔行系统的研究与FPGA设计

本文采用基于运动补偿的算法,对去隔行系统及其FPGA设计作了深入的研究.该系统包括三个关键模块运动估计模块是去隔行系统的设计重点,设计为双向运动估计,采用菱形快速搜索算法,主要分为计算和控制两大部分.计算部分为SAD计算模块,采用累加树和流水线技术;控制部分根据菱形搜索算法的第三步搜索的特点,对比较模块、SAD暂存器 ...

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学术论文  802.3快速以太网MAC层研究及其在FPGA的实现

本文主要阐述基于FPGA对IEEE802.3快速以太网MAC层功能的实现.首先介绍了以太网协议以及快速以太网接入无源光网EPON的原理,然后重点阐述了MAC层的FPGA设计、仿真及测试.先总体介绍了对整个MAC系统的内部结构、模块划分,再对各个模块的设计进行了详细的描述,接着介绍了开发环境和验证工具,之后给出了测试方案,验证数据、实现 ...

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学术论文  嵌入式USB总线器件端处理器的FPGA实现研究

　　本文提出了一种适合于嵌入式SoC的USB器件端处理器的硬件实现结构。并主要研究了USB器件端处理器的RTL级实现及FPGA原型验证、和ASIC实现研究，包括从模型建立、算法仿真、各个模块的RTL级设计及仿真、FPGA的下载测试和ASIC的综合分析。它的速度满足预定的48MHz，等效门面积不超过1万门，完全可应用于SOC设计中。　　本文 ...

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