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文件格式  粒子滤波器和姿态处理的论文

粒子滤波器和姿态处理的论文，这是粒子滤波的实现,可以实现基本的粒子滤波的算法,也就是用MARLAB实验粒子滤波的程序.

https://www.eeworm.com/dl/639/219735.html

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汇编语言  IIR型3阶切比雪夫1型高通滤波器的采样频率（Fs)为1200Hz,截至频率为200Hz

IIR型3阶切比雪夫1型高通滤波器的采样频率（Fs)为1200Hz,截至频率为200Hz

https://www.eeworm.com/dl/644/220365.html

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其他书籍  非常详细的讲述了如何设计好滤波器

非常详细的讲述了如何设计好滤波器，英文版

https://www.eeworm.com/dl/542/220857.html

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其他  一个3阶的CIC内插滤波器

一个3阶的CIC内插滤波器，可作为delta sigma DAC升采样率模块，用于半带滤波器后。

https://www.eeworm.com/dl/534/222690.html

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其他  matlab数字滤波器

matlab数字滤波器，cic，hb，fir 滤波器欢迎参考

https://www.eeworm.com/dl/534/223233.html

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其他  优化的IIR滤波器

优化的IIR滤波器，8个零点，8个极点

https://www.eeworm.com/dl/534/223254.html

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通讯/手机编程  VHDL语言实现了IS-95标准中的48阶成型滤波器。工作速率80Mbps。接收发送端均可使用。

VHDL语言实现了IS-95标准中的48阶成型滤波器。工作速率80Mbps。接收发送端均可使用。

https://www.eeworm.com/dl/527/223485.html

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系统设计方案  给出了一种适用于PHS基带系统中的高性能成形滤波器,对比两种实现方法在基带芯片中的性能,利用最少的非零比特位来表示符号数的编码技术即符号数(Canonic Sign Digit, CSD) 。

给出了一种适用于PHS基带系统中的高性能成形滤波器,对比两种实现方法在基带芯片中的性能,利用最少的非零比特位来表示符号数的编码技术即符号数(Canonic Sign Digit, CSD) 。

https://www.eeworm.com/dl/678/223840.html

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系统设计方案  提出了一种基于FPGA的高阶高速F IR滤波器的设计与实现方法。通过一个169阶的均方根升余弦滚降滤波器的设计,介绍了如何应用流水线技术来设计高阶高速F IR滤波器,并且对所设计的 FIR滤波器

提出了一种基于FPGA的高阶高速F IR滤波器的设计与实现方法。通过一个169阶的均方根升余弦滚降滤波器的设计,介绍了如何应用流水线技术来设计高阶高速F IR滤波器,并且对所设计的 FIR滤波器性能、资源占用进行了分析。

https://www.eeworm.com/dl/678/223842.html

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VHDL/FPGA/Verilog 11 阶FIR 数字滤波器,verolog描述

11 阶FIR 数字滤波器,verolog描述，通过modelsim 6.0 仿真，Quartue综合

https://www.eeworm.com/dl/663/223997.html

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