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教程资料 FPGA和CPLD设计时的经验
FPGA和CPLD设计时的经验和大家一共分享，开发FPGA时很好的资料
教程资料 用cpld开发的激光控制器的源码
用cpld开发的激光控制器的源码，已经是成型产品，希望对大家有用
教程资料 VHDL语言编写的FIR滤波器源码
VHDL语言编写的FIR滤波器源码\r\n对于嵌入式设计者有很好的指导作用\r\n
教程资料 基于CPLD的二进制码转换为二十进制（BCD）码的电路
基于CPLD的二进制码转换为二十进制（BCD）码的电路[1].pdf
教程资料 cpld,非常好用的源码
cpld,非常好用的源码.可以为你带来方便.
教程资料 实现基于CPLD的CCD采集系统设计源码
实现基于CPLD的CCD采集系统设计源码
教程资料 51单片机系统扩展超大容量存储器接口设计的cpld源码。
51单片机系统扩展超大容量存储器接口设计的cpld源码。
教程资料 计PLD/FPGA时通常采用几种时钟类型
无沦是用离散逻辑、可编程逻辑，还是用全定制硅器件实现的任何数字设计，为了成功地操\r\n作，可靠的时钟是非常关键的。设计不良的时钟在极限的温度、电压或制造工艺的偏差情况下将\r\n导致错误的行为，并且调试困难、花销很大。 在设计PLD/FPGA时通常采用几种时钟类型。时钟可\r\n分为如下四种类型：全局时钟、门控时钟、 ...
教程资料 VERILOG HDL 实际工控项目源码
VERILOG HDL 实际工控项目源码\r\n开发工具 altera quartus2
教程资料 用CPLD控制LED、数码管的显示源代码
工作原理：\r\n 脉冲输入，记录30个脉冲的间隔时间（总时间），LED显示出来，牵涉到数码管的轮流点亮，以及LED的码。输入端口一定要用个\r\n74LS14整一下，图上没有。数码管使用共阴数码管。MAXPLUS编译。\r\n测试时将光电门的信号端一块连接到J2口的第三管脚，同时第一管脚为地，应该与光电门的地连接（共地）。\r\n开始测 ...