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VHDL/FPGA/Verilog FPGA数字移相器,编程环境为QUIRTE2,编程语言采用硬件描述语言vhdl

FPGA数字移相器,编程环境为QUIRTE2,编程语言采用硬件描述语言vhdl

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uCOS ReverseSort程序描述：本程序包括：线性链表的逆序(从尾到头排序),链表正常排序(按.num项从大到小排序)

ReverseSort程序描述：本程序包括：线性链表的逆序(从尾到头排序),链表正常排序(按.num项从大到小排序)，链表输出

https://www.eeworm.com/dl/649/158195.html

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数据结构  转子动平衡的几个优化算法影响系数法定位相角最佳算法

转子动平衡的几个优化算法影响系数法定位相角最佳算法

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嵌入式/单片机编程  步进电机的和序

步进电机的和序，可以学习下，每次7.5度，一周48次

https://www.eeworm.com/dl/647/158661.html

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汇编语言  <汇编语言程序设计》-相伟-源代码.对你可能有些帮助

<汇编语言程序设计》-相伟-源代码.对你可能有些帮助

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matlab例程  绘制庞加莱截面图,在相空间中适当（要有利于观察系统的运动特征和变化

绘制庞加莱截面图,在相空间中适当（要有利于观察系统的运动特征和变化，如截面不能与轨线相切，更不能包含轨线）选取一截面，在此截面上某一对共轭变量如x1和x.1取固定值，称此截面为Poincare截面，相空间的连续轨迹与Poincare截面的交点成为截点。 ...

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数据结构  最优合并问题给定K个排好序的序列s1,s2,...,sk,用2 路合并算法将这k个序列合并成一个序列。假设所采用的2路合并算法合并2个长度分另为m 和n的序列需要m+n-1次比较。试设计一个

最优合并问题给定K个排好序的序列s1,s2,...,sk,用2 路合并算法将这k个序列合并成一个序列。假设所采用的2路合并算法合并2个长度分另为m 和n的序列需要m+n-1次比较。试设计一个算法确定合并这个序列的最优合并顺序，使所需的总比较次数最少。 ...

https://www.eeworm.com/dl/654/159248.html

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单片机开发  晶闸管的触发方式有移相触发和过零触发两种.files

晶闸管的触发方式有移相触发和过零触发两种.files

https://www.eeworm.com/dl/648/159346.html

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数据结构  按作业效益非增序输入作业的截止期限

按作业效益非增序输入作业的截止期限，要求使用上述规则设计出一个算法，使得输出为一个作业可行集j[]。即如果作业i可以在截止期限前执行完毕则将其加入j[]。这样得出的一个结果是最优解，可以获得最大的效益值。

https://www.eeworm.com/dl/654/159455.html

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其他  锁相环设计文档和一个可执行文件

锁相环设计文档和一个可执行文件

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