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文章/文档 本文描述的是数字式频率计的设计过程
本文描述的是数字式频率计的设计过程，其中包含了所用到的VHDl语言的源代码，和仿真图型，是比较完整描述的设计数字频率计的文章
VHDL/FPGA/Verilog 频率计VHDL编程。设计一个4位数字显示的十进制频率计
频率计VHDL编程。设计一个4位数字显示的十进制频率计，其测量范围为1MHz，测量值通过4个数码管显示以8421BCD码形式输出，可通过开关实现量程控制，量程分10kHz、100kHz、1MHz三档(最大读数分别为9.999kHz、99.99kHz、999.9kHz)；
当输入信号的频率大于相应量程时，有溢出显示。 ...
单片机开发 频率计的设计,单片机初学者必须程序,适用于proteus
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VHDL/FPGA/Verilog 此示例是8051核加频率计的联合设计,带有8051IP核资料
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VHDL/FPGA/Verilog 利 用 来 vhdl 设 计 p cm的 实 现
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数学计算 信号相位匹配原理的正弦信号参数的最小二乘估计
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VHDL/FPGA/Verilog 基于AVR的数字频率计
基于AVR的数字频率计，使用LCD1602做显示。刷新速度1S，含电路图