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VHDL/Verilog/EDA源码  采用等精度测频原理的频率计程序

采用等精度测频原理的频率计程序与仿真：4位显示的等精度频率计。

https://www.eeworm.com/dl/504/16119.html

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教程资料  基于FPGA数字频率计的实现

基于FPGA数字频率计的实现，文中有所有的源代码，仅供参考。

https://www.eeworm.com/dl/fpga/doc/17478.html

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教程资料  基FPGA Cyclone II_EP2C5 EP2C8的频率计

基FPGA Cyclone II_EP2C5 EP2C8的频率计

https://www.eeworm.com/dl/fpga/doc/17480.html

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教程资料  基于FPGA的数字频率计的设计11利用VHDL 硬件描述语言设计

基于FPGA的数字频率计的设计11利用VHDL 硬件描述语言设计,并在EDA(电子设计自动化) 工具的帮助下,用大规模可编程逻辑器件(FPGA/ CPLD) 实现数字频率计的设计原理及相关程序

https://www.eeworm.com/dl/fpga/doc/17512.html

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教程资料  FPGA设计频率计全套资料

FPGA设计频率计全套资料，我希望对大家啊好似有用的

https://www.eeworm.com/dl/fpga/doc/17565.html

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教程资料  MAXPLUS_环境下的频率计设计及其完善

MAXPLUS_环境下的频率计设计及其完善

https://www.eeworm.com/dl/Protel/doc/17671.html

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教程资料  用FPGA实现相位的测量

有ＰＦＧＡ实现相位的测量，解决一些电路问题

https://www.eeworm.com/dl/fpga/doc/17685.html

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教程资料  对硅微谐振式加速度计的数据采集电路开展研究工作

项目的研究内容是对硅微谐振式加速度计的数据采集电路开展研究工作。硅微谐振式加速度计敏感结构输出的是两路差分的频率信号，因此硅微谐振式加速度计数据采集电路完成的主要任务是测出两路频率信号的差值。测量要求是：实现10ms内对中心谐振频率为20kHz、标度因数为100Hz/g、量程为±50g、分辨率为1mg的硅微谐振式加速度计 ...

https://www.eeworm.com/dl/Protel/doc/17754.html

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教程资料  设计了一种基于ＣＰＬＤ（复杂可编程逻辑器件）的低频数字相位测量仪

设计了一种基于ＣＰＬＤ（复杂可编程逻辑器件）的低频数字相位测量仪

https://www.eeworm.com/dl/Protel/doc/17758.html

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教程资料  基于FPGA的快速反正切运算实现方法可以用于解调的相位计算

基于FPGA的快速反正切运算实现方法可以用于解调的相位计算

https://www.eeworm.com/dl/fpga/doc/17883.html

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