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相位差计 的查询结果
VHDL/FPGA/Verilog 这个是在vhdl环境下的频率计的系统设计。
这个是在vhdl环境下的频率计的系统设计。
VHDL/FPGA/Verilog [frequent.rar] - 等精度频率计的设计
[frequent.rar] - 等精度频率计的设计，已经在实验箱上运行的。
VHDL/FPGA/Verilog 用quartus6原理编辑方式写的简易频率计我自己的实验来的 保证能使请您认真查看谢谢
用quartus6原理编辑方式写的简易频率计我自己的实验来的 保证能使请您认真查看谢谢
VHDL/FPGA/Verilog 用QUARTUS编译通过的等精度频率计
用QUARTUS编译通过的等精度频率计，我错误，但有几个警告（不影响设计）。我的毕业设计啊！！！
Jsp/Servlet 一份关于计computerPad的java程序
一份关于计computerPad的java程序
单片机开发 基于ADI公司加速度传感器的计步器算法,MCU采用ATMega48,加速度传感器采用ADXL330
基于ADI公司加速度传感器的计步器算法,MCU采用ATMega48,加速度传感器采用ADXL330
汇编语言 2.5GHz智频率计
2.5GHz智频率计
嵌入式/单片机编程 简易频率计 里面包含有程序及仿真 还有电路原理图
简易频率计 里面包含有程序及仿真
还有电路原理图
单片机开发 用汇编编写的运行在51单片机的简易频率计
用汇编编写的运行在51单片机的简易频率计，测量范围可以是1Hz-8MHz,
VHDL/FPGA/Verilog ：频率计。具有4位显示
：频率计。具有4位显示，能自动根据7位十进制计数的结果，自动选择有效数据的
--高4位进行动态显示。小数点表示是千位，即KHz。