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VHDL/FPGA/Verilog 一个可综合的同步FIFO的verilog源代码
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通讯编程文档 一种用于非同步采样下的通信时
一种用于非同步采样下的通信时，通过误差测量算法和多项式插值以达到同步的目地的论文。来源于I
VHDL/FPGA/Verilog 一个verilog语言描写的同步fifo,包括:Fifo using declared registers for storage和Fifo using (model of) standard mem
一个verilog语言描写的同步fifo,包括:Fifo using declared registers for storage和Fifo using (model of) standard memory chip for storage.两种方式,包含testbench
网络 NTP协议的实现 可以使用该程序将linux主机的时间和网络ntp server同步时间
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书籍源码 5相位编组法实现纹理直线边缘的检测程序代码(代码以子函数形式给出) function gradephase(x)
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汇编语言 这个是关于实现同步电机FOC的控制程序源代码
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驱动编程 usb主机驱动 同步端点 用于 语音视频
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VHDL/FPGA/Verilog 基于FPGA的新型数据位同步时钟提取(CDR)实现方法
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