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直接数字频率合成 的查询结果
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VHDL/FPGA/Verilog 用VHDL设计直接数字频率合成器
用VHDL设计直接数字频率合成器
VHDL/FPGA/Verilog 直接数字频率合成器
直接数字频率合成器，基于vhdl语言，在qartus II上实现，下载调试成功
其他 直接数字频率合成器中相位累加杂散
直接数字频率合成器中相位累加杂散，幅度量化杂散及DAC非线性杂散的功率谱密度曲线频谱图
VHDL/FPGA/Verilog DDs直接数字频率合成器的源代码
DDs直接数字频率合成器的源代码，其中包括采用IP核和普通两种方式
单片机开发 脉冲发生测试.此程序为AD9850（DDS）直接数字频率合成器C语言源码。用125M的有源晶振
脉冲发生测试.此程序为AD9850（DDS）直接数字频率合成器C语言源码。用125M的有源晶振，频率无失真输出可达到40M。
VHDL/FPGA/Verilog 本章介绍了两个EDA技术的综合应用设计实例:数字闹钟和直接数字频率合成器DDS。
本章介绍了两个EDA技术的综合应用设计实例:数字闹钟和直接数字频率合成器DDS。
VHDL/FPGA/Verilog 用vhdl来实现的数字频率合成的技术
用vhdl来实现的数字频率合成的技术，几乎很全的，所有的都有
VHDL/FPGA/Verilog 实现数字频率合成。能产生任意频率的正弦信号、方波信号、梯形波等
实现数字频率合成。能产生任意频率的正弦信号、方波信号、梯形波等，并且能对信号的频率进行测量。
VHDL/FPGA/Verilog 基于FPGA的直接数字频率合成器（DDS）设计 （源程序）
基于FPGA的直接数字频率合成器（DDS）设计
（源程序）
文件格式 此为使用DDS直接数字频率合成器之设计报告,作者相当的详细介绍DDS之原理以及使用Altera之FPGA做设计,供使用者参考.
此为使用DDS直接数字频率合成器之设计报告,作者相当的详细介绍DDS之原理以及使用Altera之FPGA做设计,供使用者参考.