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直接数字合成器 的查询结果
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其他 直接数字频率合成器中相位累加杂散
直接数字频率合成器中相位累加杂散，幅度量化杂散及DAC非线性杂散的功率谱密度曲线频谱图
VHDL/FPGA/Verilog DDs直接数字频率合成器的源代码
DDs直接数字频率合成器的源代码，其中包括采用IP核和普通两种方式
单片机开发 脉冲发生测试.此程序为AD9850（DDS）直接数字频率合成器C语言源码。用125M的有源晶振
脉冲发生测试.此程序为AD9850（DDS）直接数字频率合成器C语言源码。用125M的有源晶振，频率无失真输出可达到40M。
VHDL/FPGA/Verilog 本章介绍了两个EDA技术的综合应用设计实例:数字闹钟和直接数字频率合成器DDS。
本章介绍了两个EDA技术的综合应用设计实例:数字闹钟和直接数字频率合成器DDS。
VHDL/FPGA/Verilog 基于FPGA的直接数字频率合成器（DDS）设计 （源程序）
基于FPGA的直接数字频率合成器（DDS）设计
（源程序）
文件格式 此为使用DDS直接数字频率合成器之设计报告,作者相当的详细介绍DDS之原理以及使用Altera之FPGA做设计,供使用者参考.
此为使用DDS直接数字频率合成器之设计报告,作者相当的详细介绍DDS之原理以及使用Altera之FPGA做设计,供使用者参考.
VHDL/FPGA/Verilog 《DDS原理简介(中文)》DDS即直接数字频率合成器
《DDS原理简介(中文)》DDS即直接数字频率合成器，原理及系统设计实现
单片机开发 直接数字频率直接数字频率合成器(DDS)合成器(DDS)
直接数字频率直接数字频率合成器(DDS)合成器(DDS)
系统设计方案 FPGA实现的直接数字频率合成器
FPGA实现的直接数字频率合成器，本文基于DDS的基本原理,利用Altera公司的FPGA芯片FLEX10系列器件完成了一个DDS系统的设计。
通讯/手机编程 比较先进的直接数字频率合成器的设计。可用于频率的合成。
比较先进的直接数字频率合成器的设计。可用于频率的合成。