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教程资料  Viterbi编解码器的完整vhdl代码

论文格式，内含Viterbi编解码器的完整vhdl代码，文件为.nh格式

https://www.eeworm.com/dl/fpga/doc/18639.html

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教程资料  基于CPLD-FPGA的半整数分频器的设计

基于CPLD-FPGA的半整数分频器的设计，用于设计EDA

https://www.eeworm.com/dl/fpga/doc/18662.html

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教程资料  数控振荡器的频率控制字寄存器、相位控制字寄存器、累加器和加法器可以用VHDL语言描述

数控振荡器的频率控制字寄存器、相位控制字寄存器、累加器和加法器可以用VHDL语言描述，集成在一个模块中，提供VHDL源程序供大家学习和讨论。\r\n

https://www.eeworm.com/dl/fpga/doc/18672.html

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教程资料  VHDL源程序：半整数分频器电路

半整数分频器电路的VHDL源程序，供大家学习和讨论。\r\n

https://www.eeworm.com/dl/fpga/doc/18701.html

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教程资料  JTAG仿真器CPLD

JTAG仿真器CPLD

https://www.eeworm.com/dl/Protel/doc/18711.html

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教程资料  利用FPGA实现的可编程综合采样器

利用FPGA实现的可编程综合采样器\r\nAProgrammableIntegratedSamplerUsingFPGA

https://www.eeworm.com/dl/fpga/doc/18770.html

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教程资料  viterbi译码器的一种fpga实现

viterbi译码器的一种fpga实现.是一个cs252\r\n的project的result\r\n供大家研究用

https://www.eeworm.com/dl/fpga/doc/18797.html

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allegro GD-06 ALLEGRO通用GSM拨号器

D-06&nbsp; ALLEGRO 是通用型的GSM拨号器和控制器，它既可以用于家庭又可以用于工业自动控制，用于安全防范或远程数据传输工程，触发任何一个输入端将会使得该装置以短信的方式发送报告到已编好程的电话号码上或直接打电话，通过发送特定的短信到该装置上，你可以打开或关闭远端控制输出端。基本设定是，GD-06提供4个输入触 ...

https://www.eeworm.com/dl/allegro/20119.html

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Genesis genesis9.0算号器_算号器视频文件

genesis9.0算号器提供genesis算号器使用视频。安装文件一定要放在小写英文路径下，中文不行，有大写字母的英文也不行。1.算号器的只是算gnd的号，要算get的号，需要参考算号器的步骤。注意选择破解有效时间。2.7天过期，30天过期，永不过期等。注意要用自己机器识别号去算，在get运行弹出来的序号对话框里，有机器识别号 ...

https://www.eeworm.com/dl/Genesis/20137.html

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模拟电子  面向舰艇通用数据采集的协议转换器的设计与测试

针对目前舰艇系统通用数据采集需要，设计了一种基于DSP的协议转换器。克服了目前由于舰艇作战系统使用接口协议多样而造成通用性差的问题。通过在实验室环境下的组建数据采集系统并进行性能测试，证明该协议转换器能满足现阶段舰艇多接口数据采集的要求，新研制或改进的数据采集系统能满足高度通用化的需要。 ...

https://www.eeworm.com/dl/571/20262.html

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