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找到约 52,236 项符合 状态机设计 的查询结果

VHDL/FPGA/Verilog VHDL实例

VHDL实例,各个方面均有,基本语法,状态机,汉明码,寄存器,步进电机控制器,表决器,多路选择器,译码器等等
https://www.eeworm.com/dl/663/487908.html
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VHDL/FPGA/Verilog 分析二进制乘法中计算步骤(多少次加法

分析二进制乘法中计算步骤(多少次加法,何时进行),实现一个有限状态机,执行乘法运算。
https://www.eeworm.com/dl/663/493444.html
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单片机开发 计时显示电路,6片七段数码管显示

计时显示电路,6片七段数码管显示,内部计数器,通过Mealy型状态机实现
https://www.eeworm.com/dl/648/494331.html
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VHDL/FPGA/Verilog veriolg基于状态机的字符检测

从大写和小写的两个字符流里检测出需要的字符,之后输出
https://www.eeworm.com/dl/506487.html
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VHDL/Verilog/EDA源码 液晶驱动电路的VHDL源程序

采用状态机实现LCD1602的静态显示,重要程序语句有简介
https://www.eeworm.com/dl/511216.html
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源码 按键单击长击检测

采用状态机检测按键状态,包括单击,长击,连击。有详细代码,原理图
https://www.eeworm.com/dl/513298.html
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源码 序列检测算法

检测“10110”序列的verilogHDL语言,使用状态机实现序列检测
https://www.eeworm.com/dl/515857.html
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技术资料 IIC接口E2PROM(AT24C64) 读写VERILOG 驱动源码+仿真激励文件: module

IIC接口E2PROM(AT24C64) 读写VERILOG 驱动源码+仿真激励文件:module i2c_dri    #(      parameter   SLAVE_ADDR = 7'b1010000   ,  //EEPROM从机地址      parameter   CLK_FREQ   = 26'd50_000_000, //模块输入的时钟频率 ...
https://www.eeworm.com/dl/745257.html
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技术资料 弗洛伊德 数字电子技术Digital Fundamentals global edition

弗洛伊德 (Thomas L.Floyd) (作者), 余璆 (译者)。《国外电子与通信教材系列:数字电子技术(第10版)》是一本关于数字电子技术的经典教材。最新版适应全球化。带来了新的一些改动,包括图画更丰富,引进了 Moore and Mealy 状态机等。
https://www.eeworm.com/dl/837230.html
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VIP专区 VIP专区-单片机源代码精选合集系列(13)

eeworm.com VIP专区 单片机源码系列 13资源包含以下内容:1. AVR_动态数组赋值.doc2. 糊里糊涂学STM32单片机.pdf3. 基于DS18B20的煤井多点温度测量系统研究.pdf4. 堪称一绝的“IO 口扫键”法.pdf5. 基于FM1702射频识别读写器的设计与实现.pdf6. 51单片机_遥控_温度控制系统(含源代码).wps7. f340的MP3程序,通过SD卡读入解 ...
https://www.eeworm.com/vipdownload/13.html
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