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状态机设计 的查询结果
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嵌入式Linux 关于嵌入式PCB板UI的程序
关于嵌入式PCB板UI的程序，包含状态机等一些程序。
VHDL/FPGA/Verilog 66个vhdl的常用源代码
66个vhdl的常用源代码，包括有双向口、状态机等，自解压后看vhdl_example.html列表说明.exe
数据结构 《Delphi算法与数据结构》源码 Delphi开发人员Julian Bucknall从实用角度为广大程序员提供了有关使用算法和数据结构的一个详尽的介绍。Bucknall先从算法性能的讨论开始
《Delphi算法与数据结构》源码
Delphi开发人员Julian Bucknall从实用角度为广大程序员提供了有关使用算法和数据结构的一个详尽的介绍。Bucknall先从算法性能的讨论开始，涵盖了诸如数组、链表和二叉树等内容。这本书强调了查找算法（如顺序和二分查找），另外也重点介绍了排序算法（包括冒泡排序、插入排序、希尔排序、快速 ...
单片机开发 用ATmega16实现的多功能带音乐闹铃（老鼠爱大米）的数字时钟
用ATmega16实现的多功能带音乐闹铃（老鼠爱大米）的数字时钟，有3个功能键设置。具体功能为：秒表计时，闹铃音乐，时钟，校时设置。可以学习状态机的编程思想。
嵌入式/单片机编程 verilog程序
verilog程序，实现两个16bit数乘法，采用booth算法，基于状态机实现，分层次为datapath和controller两个子模块，testBench测试通过
VHDL/FPGA/Verilog 朋友
朋友，我是Jawen.看到先前上载的一套CPLD开发板的VHDL源码挺受欢迎的，现在就将她的Verilog源码也一并贡献给大家：8位优先编码器,乘法器,多路选择器,二进制转BCD码,加法器,减法器,简单状态机,四位比较器,7段数码管,i2c总线,lcd液晶显示,拨码开关,串口,蜂鸣器,矩阵键盘,跑马灯,交通灯,数字时钟 ...
VHDL/FPGA/Verilog vga控制电路原码。主要有时序产生模块
vga控制电路原码。主要有时序产生模块，彩条产生模块和接口模块。改程序主要用状态机来实现，两个计数器来控制状态的翻转。
VHDL/FPGA/Verilog VHDL的49个例子
VHDL的49个例子，例子丰富，有计数器、状态机、寄存器、汉明纠错码编码器、游戏程序
软件设计/软件工程 这个是我新编译的程序代码
这个是我新编译的程序代码，主要是实现状态机的采样功能