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DSP编程 现代雷达普遍采用相参信号处理,而如何获得高精度基带数字正交( I , Q) 信号是整个系统信号处理成败的关键,以前通常的做法是采用模拟相位检波器得到I、Q信号,其正交性能一般为:幅度平衡在2 ％ 左右
现代雷达普遍采用相参信号处理,而如何获得高精度基带数字正交( I , Q) 信号是整个系统信号处理成败的关键,以前通常的做法是采用模拟相位检波器得到I、Q信号,其正交性能一般为:幅度平衡在2 ％ 左右, 相位正交误差在2°左右,即幅相误差引入的镜像功率在- 34dB 左右。这限制了信号处理器性能的提高, 为此, 近年来提出了对低中 ...
DSP编程 中频验波是对信号进行中频直接采样和数字正交处理后,产生的I 支路和Q 支路信号序列在时间上会错开一个采样间隔,需要进行定序处理,恢复成同步输出的I、Q 两路信号序列。现代雷达普遍采用相参信号处理,而如
中频验波是对信号进行中频直接采样和数字正交处理后,产生的I 支路和Q 支路信号序列在时间上会错开一个采样间隔,需要进行定序处理,恢复成同步输出的I、Q 两路信号序列。现代雷达普遍采用相参信号处理,而如何获得高精度基带数字正交( I , Q) 信号是整个系统信号处理成败的关键,以前通常的做法是采用模拟相位检波器得到I、Q信 ...
VHDL/FPGA/Verilog FPGA程序的top.v文件
FPGA程序的top.v文件，主要实现DDS信号发生器功能，通过定时器，可简单实现输出幅值无极跳变
其他 实现对四个人进行抢答
实现对四个人进行抢答，有抢答鉴别模块，转换模块，3选1模块，倒计时模块COUNT，该模块实现答题时间的倒计时，在计满100s后送出声音提示。
操作系统开发 设计一个请求页式存储管理方案。并编写模拟程序实现。 产生一个需要访问的指令地址流。它是一系列需要访问的指令的地址。为不失一般性
设计一个请求页式存储管理方案。并编写模拟程序实现。
产生一个需要访问的指令地址流。它是一系列需要访问的指令的地址。为不失一般性，你可以适当地（用人工指定地方法或用随机数产生器）生成这个序列。为简单起见，页面淘汰算法采用FIFO页面淘汰算法，并且在淘汰一页时，只将该页在页表中抹去。而不再判断它是否被改写过 ...
数学计算 test1.txt 第一列为时间t
test1.txt 第一列为时间t，0.001s为步长；第二列为系统的输入信号；第三列为系统的输出信号。
signal_analyzer.m首先将test1.txt 的数据读入workspace，然后进行FFT，分析出两信号的频率，输出对于输入的幅值衰减（db），输出对输入的相位差。 ...
其他 //顺序表的建立、查找、插入与删除 #include <stdio.h> #include <malloc.h> #include <stdlib.h> #
//顺序表的建立、查找、插入与删除
#include <stdio.h>
#include <malloc.h>
#include <stdlib.h>
#define ListSize 100 //表最大长度
//结构定义
typedef struct SeqList
{
int node[ListSize] //存放表结点
int length //当前表长度
} SeqList
//插入元素
insertList(SeqList *list, int e)
{
int i=list->length-1 ...
单片机开发 采用两个定时器合用
采用两个定时器合用，T0设置为定时方式，T1设置为计数方式。T0定时时间为50ms，计满产生的输出信号由P1.7口发光二极管显示。同时还将该信号输入到计数器T1（P3.5脚）作为T1的计数输入脉冲，当输入信号产生由1到0的跳变时触发计数器工作,使计数器的值增1。计数器T1的初始值设置为100，计满时所用的时间为50ms×2×100，即10s ...
单片机开发 并行接口电流输出型DA转换器的控制
并行接口电流输出型DA转换器的控制，包括延时子程序，完成一次转换子程序，完成满值点验证、零值点验证子程序等