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可编程逻辑  编码器倍频、鉴相电路在FPGA中的实现

编码器倍频、鉴相电路在FPGA中的实现

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其他嵌入式/单片机内容  工频正玄波的逆变器电路

工频正玄波的逆变器电路，成熟使用的方案，请用作设计参考，thx

https://www.eeworm.com/dl/687/142375.html

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其他  射频RF读卡器的设计电路（印制板和原理图）

射频RF读卡器的设计电路（印制板和原理图）

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其他嵌入式/单片机内容  带分频器的bcd计数电路设计

带分频器的bcd计数电路设计，verilog源码

https://www.eeworm.com/dl/687/153387.html

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VHDL/FPGA/Verilog 半整数分频器电路的VHDL源程序

半整数分频器电路的VHDL源程序，供大家学习和讨论。

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单片机开发  PIC单片机控制FM1702SL源程序+原理图 FM1702SL射频模块底层驱动源程序,适用于PIC内核单片机,电路原理图为Protel 99 SE格式。

PIC单片机控制FM1702SL源程序+原理图 FM1702SL射频模块底层驱动源程序,适用于PIC内核单片机,电路原理图为Protel 99 SE格式。

https://www.eeworm.com/dl/648/217909.html

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其他  利用ewb实现二倍频的电路

利用ewb实现二倍频的电路

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RFID编程  DPLL由鉴相器模K加减计数器脉冲加减电路同步建立侦察电路模N分频器构成. 整个系统的中心频率(即signal_in和signal_out的码速率的2倍) 为clk/8/N. 模K

DPLL由鉴相器模K加减计数器脉冲加减电路同步建立侦察电路模N分频器构成. 整个系统的中心频率(即signal_in和signal_out的码速率的2倍) 为clk/8/N. 模K加减计数器的K值决定DPLL的精度和同步建立时间,K越大,则同步建立时间长,同步精度高.反之则短,低. ...

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嵌入式/单片机编程  射频卡读卡电路和程序,以及网络芯片8019的电路和程序,功能是实现一个射频卡读卡,读出数据传输到上位机.通过网络.

射频卡读卡电路和程序,以及网络芯片8019的电路和程序,功能是实现一个射频卡读卡,读出数据传输到上位机.通过网络.

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VHDL/FPGA/Verilog 用VHDL实现数字频率计,1. 时基产生与测频时序控制电路模块2. 待测信号脉冲计数电路模块3.锁存与译码显示控制电路模块4.顶层电路模块.

用VHDL实现数字频率计,1. 时基产生与测频时序控制电路模块2. 待测信号脉冲计数电路模块3.锁存与译码显示控制电路模块4.顶层电路模块.

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