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浮点算法 的查询结果
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VHDL/FPGA/Verilog 是codic算法实现Sin的浮点C程序
是codic算法实现Sin的浮点C程序，包括定点和浮点程序，已经通过验证.
系统设计方案 研究实现MUSIC算法的DSP＋FPGA、浮点运算与定点运算混合的硬件设计方案。
研究实现MUSIC算法的DSP＋FPGA、浮点运算与定点运算混合的硬件设计方案。
学术论文 基于FPGA的浮点运算器设计.rar
随着电子工业应用领域需求的增长，要实现复杂程度较高的数字电子系统，对数据处理能力提出越来越高的要求。定点运算已经很难满足高性能数字系统的需要，而浮点数相对于定点数，具有表述范围宽，有效精度高等优点，在航空航天、遥感、机器人技术以及涉及指数运算和信号处理等领域有着广泛的应用。对浮点运算的要求主要体现在 ...
学术论文 基于FPGA浮点运算器的设计
在很多高精度计算场合需要采用浮点运算。过去用门电路进行各种运算通常为定点运算，但其计算精度有限。随着现场可编程门阵（FPGA）的迅速发展，可以采用FPGA实现浮点运算。 本文首先介绍定点数和浮点数的格式，完成基于FPGA的几种常用浮点运算器的VHDL设计，包括浮点数与定点数之间的相互转换，浮点加法器、减法器、乘法器 ...
学术论文 用FPGA实现带硬件浮点运算器的8051
8051系列是至今为止最成功的单片机之一，在FPGA平台上研究带硬件浮点运算器的8051是对其在SoC及专用化的方向上的一次迈进。文章首先介绍了8051的基本架构，包括硬件模块、指令系统、内存分配以及基本外设。然后讲解了在设计8051时如何划分模块，每个模块的功能与设计，同时也介绍了如何设计流水线来加速8051的处理速度。对 ...
DSP编程 文件包为浮点快速傅立叶变换（32点）的汇编代码
文件包为浮点快速傅立叶变换（32点）的汇编代码，运行在ADI的Visual DSP++平台上，由于结合了并行流水线指令，该算法具有很高的运行效率，可以被广泛使用在高速数字信号处理方面。
其他嵌入式/单片机内容 ieee公布的标准8位浮点乘法器
ieee公布的标准8位浮点乘法器，可综合。采用标准算法。
单片机开发 程序说明:浮点数变为压缩BCD码,保存在以数组中 第1字节的位7:0正,1负.位6:0(位5--0代表小数点前的位数),1(位5--0代表小数 点后0的位数) 2--4字节为压缩BCD码,有
程序说明:浮点数变为压缩BCD码,保存在以数组中
第1字节的位7:0正,1负.位6:0(位5--0代表小数点前的位数),1(位5--0代表小数
点后0的位数)
2--4字节为压缩BCD码,有效位为7位,3个半字节，最后半个字节请使用者自行放
弃
程序占用资源PSW,A,B,DPTR,R0--R7,SP深度6,RAM 5个放数据
keil 兼容,调用KEIL 的FPMUL子程序。
程序作 ...
VHDL/FPGA/Verilog MTD定点浮点仿真
MTD定点浮点仿真，可直接用于fpga算法的仿真程序，产生了扫频信号，仿真直接输出系统频率响应函数，为系统测试带来好处