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VHDL/FPGA/Verilog 除法器实验 verilog CPLD EPM1270 源代码
除法器实验
verilog CPLD
EPM1270
源代码
VC书籍 实现一个具有加、减、乘、除功能的简单的计算器
实现一个具有加、减、乘、除功能的简单的计算器，c语言实现
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IJG组织的JPEG压缩程序的源代码,这里的JPEG压缩程序仅限于灰度图像的压缩，比较简单。文中的算术编码的程序实现参考了Guido Vollbeding 为JPEG压缩编写的算术编码程序。
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使用matlab中的伪彩色增强方法对CT的灰度图片进行伪彩色增强处理
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电可擦除可编程只读存储器EEPROM可分为并行和串行两大类。并行EEPROM在读写数据是通过8位数据总线传输，而串行EEPROM的数据是一位一位的传输。虽然与并行EEPROM相比，串行传输数据较慢，但它体积小、专用I/O口少、低廉、电路简单等优点，因此广泛用于智能仪器、仪表设备中。 ...
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本计算器可以进行简单的四则运算（加、减、乘、除）但仅限于十进制下，还可以进行（八进制，十进制，十六进制）之间的相互转换，八进制最多可以输入19位数，十进制最多可以输入18位数，十六进制最多可以输入14位数,backspace表示退格, clear表示初始化， ...