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格雷互补序列 的查询结果
单片机开发 最高优先级编码器 8位相等比较器 三人表决器（三种不同的描述方式） 加法器描述 8位总线收发器：74245 （注2） 地址译码（for m68008） 多路选择器（使用select语句）
最高优先级编码器 8位相等比较器
三人表决器（三种不同的描述方式） 加法器描述
8位总线收发器：74245 （注2） 地址译码（for m68008）
多路选择器（使用select语句） LED七段译码
多路选择器（使用if－else语句） 双2－4译码器：74139
多路选择器（使用when－else语句） 二进制到BCD码转换
多路选择器 （使用case语 ...
微处理器开发 fx.asm 反序输出 cpc.asm 人机对话 DECHEX.ASM 十进制到十六进制转换 PX.ASN 排序 DISP.ASM 显示非组合BCD码 COUNTA.ASM 统计字符A
fx.asm 反序输出
cpc.asm 人机对话
DECHEX.ASM 十进制到十六进制转换
PX.ASN 排序
DISP.ASM 显示非组合BCD码
COUNTA.ASM 统计字符A的个数
GRA.ASM 格雷码
TADD.ASM 加法运算
TMUL.ASM 乘法运算
数学计算 Java写的一个能在二进制
Java写的一个能在二进制，八进制，十进制，十六进制格雷码之间自由转化的工具，学习数字电路的同学可能会喜欢。
人工智能/神经网络 将遗传算法(GA)与传统SVM算法结合,构造出一种参数最优的进化SVM(GA2SVM),SVM 模型采用径向基函数(RBF)作为核函数
将遗传算法(GA)与传统SVM算法结合,构造出一种参数最优的进化SVM(GA2SVM),SVM 模型采用径向基函数(RBF)作为核函数，利用格雷码编码方式对SVM算法的模型参数进行遗传编码和优化搜索，将搜索到的优化结果作为SVM 的最终模型参数。
VHDL/FPGA/Verilog 计数器
计数器，能够由二进制计数器转化为格雷码计数器
数值算法/人工智能 BG码转换程序是一个二进制码（Binary
BG码转换程序是一个二进制码（Binary，简称 B码）与格雷码（Gray Code，简称G码）相互转换的软件．
VHDL/FPGA/Verilog 开发环境是FPGA开发工具
开发环境是FPGA开发工具，格雷码计数器的VHDL程序
VHDL/FPGA/Verilog 用双端口ram实现异步fifo
用双端口ram实现异步fifo，采用格雷码，避免产生毛刺。
VHDL/FPGA/Verilog 一种将异步时钟域转换成同步时钟域的方法
一种将异步时钟域转换成同步时钟域的方法，可节省资源，避免格雷码转换。
VHDL/FPGA/Verilog 典型的状态机
典型的状态机，简单的状态机可以不需要编码，也可以采用one-hot编码方式，如果状态很多时，采用格雷码，能有效避免亚稳态。