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VHDL/FPGA/Verilog VHDL实现 8051 CPU核 Oregano Systems 8-bit Microcontroller IP-Core

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数据结构  产生脉冲流密度为百万的雷达脉冲

产生脉冲流密度为百万的雷达脉冲，可以对信号进行能够仿真达到给出测试的信号源环境

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DSP编程  ADSP TS101 加载核。加载核在dsp上电或复位时从flash中加载应用程序

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通讯/手机编程  最小范数算法波达方向估计通信信号处理

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通讯/手机编程  tls esprit算法功率普估计波达方向估计信号处理

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通讯/手机编程  改进的music算法通信信号处理功率普估计波达方向估计

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通讯/手机编程  综合改进的music算法通信信号处理功率普估计波达方向估计

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压缩解压  最小二乘法递推算法辨识程序,输入u,输出y, 输出结果中的c矩阵中最后一列为参数估计值.

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压缩解压  VHDL语言编写的fft变换的ip核代码对算法感兴趣的可以

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邮电通讯系统  通信系统中常用的多进制数字相位调制的源代码并结合ofdm系统加入了相应的保护前缀（cp）和导频序列应用于有关ofdm的信道估计等系统

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