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教程资料  基于FPGA设计数字锁相环

基于FPGA设计数字锁相环，提出了一种由微分超前/滞后型检相器构成数字锁相环的Verilog-HDL建模方案

https://www.eeworm.com/dl/fpga/doc/18093.html

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教程资料  gps的c_a码的跟踪环的研究的fpga实现

gps的c_a码的跟踪环的研究的fpga实现

https://www.eeworm.com/dl/fpga/doc/18192.html

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教程资料  高频感应加热电源中用传统的模拟锁相环跟踪频率所存在的问题

针对高频感应加热电源中用传统的模拟锁相环跟踪频率所存在的问题,提出一种非常适合于高频感应加热的\r\n新型的数字锁相环。使用FPGA 内底层嵌入功能单元中的数字锁相环74HCT297 ,并添加少量的数字电路来实现。最后利\r\n用仿真波形验证该设计的合理性和有效性。整个设计负载范围宽、锁相时间短,现已成功应用于100 kHz/ 30 k ...

https://www.eeworm.com/dl/fpga/doc/18237.html

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教程资料  关于数字锁相环的一点东西

关于数字锁相环的一点东西,可以下来看看\r\n

https://www.eeworm.com/dl/fpga/doc/18354.html

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模拟电子  锁相环基本原理

锁相环

https://www.eeworm.com/dl/571/20266.html

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模拟电子  4046锁相环功率超声电源的频率跟踪电路

4046锁相环功率超声电源的频率跟踪电路值得参考

https://www.eeworm.com/dl/571/20281.html

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模拟电子  基于多环锁相宽带细步进频率合成器的设计

为了满足宽频段、细步进频率综合器的工程需求，对基于多环锁相的频率合成器进行了分析和研究。在对比传统单环锁相技术基础上，介绍了采用DDS+PLL多环技术实现宽带细步进频综，输出频段10~13 GHz，频率步进10 kHz，相位噪声达到-92 dBc/Hz@1 kHz，杂散抑制达到-68 dBc，满足实际工程应用需求。 ...

https://www.eeworm.com/dl/571/20345.html

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模拟电子  开环电压增益AVOL的定义与量测方法

运算放大器，开环电压增益AVOL的定义与量测方法。

https://www.eeworm.com/dl/571/20481.html

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模拟电子  基于ADF4111的锁相环频率合成器设计

为得到性能优良、符合实际工程的锁相环频率合成器，提出了一种以ADI的仿真工具ADIsimPLL为基础，运用ADS（Advanced Design System 2009）软件的快速设计方法。采用此方法设计了频率输出为930~960 MHz的频率合成器。结果表明该频率合成器的锁定时间、相位噪声以及相位裕度等指标均达到了设计目标。 ...

https://www.eeworm.com/dl/571/20485.html

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模拟电子  XS128之锁相环PLL

XS128之锁相环PLL

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