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有限状态机 的查询结果
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matlab例程 以Simulink为主要工具介绍了系统仿真方法与技巧
以Simulink为主要工具介绍了系统仿真方法与技巧，包括连续系统、离散系统、随机输入系统和复数系统的仿真。介绍了模声封装技术、电力系统模块集、非线性系统设计模块集、S-函数编写与应用、Stateflow有限状态机、虚拟现实工具箱等中高级使用方法，最后还介绍了半实物仿真技术与实时控制技术。 ...
软件工程 第一章 数字信号处理、计算、程序、算法和硬线逻辑的基本概念 第二章 Verilog HDL设计方法概述 第三章 Verilog HDL的基本语法 第四章 不同抽象级别的Verilog HDL模型
第一章 数字信号处理、计算、程序、算法和硬线逻辑的基本概念
第二章 Verilog HDL设计方法概述
第三章 Verilog HDL的基本语法
第四章 不同抽象级别的Verilog HDL模型
第五章 基本运算逻辑和它们的Verilog HDL模型
第六章 运算和数据流动控制逻辑
第七章 有限状态机和可综合风格的Verilog HDL ...
VHDL/FPGA/Verilog 台湾人梁奕智写的VHDL编程学习的PPT讲义
台湾人梁奕智写的VHDL编程学习的PPT讲义，里面包括内容有D触发器、寄存器、累加器、计数器、有限状态机等非常有用的内容。
嵌入式/单片机编程 This an exercise in using finite state machines.基于ALTERA的DE2开发 平台
This an exercise in using finite state machines.基于ALTERA的DE2开发
平台，设计一个有限状态机FSM(finite state machines).
其他 功能是检测一个5位二进制序列“10010”。考虑到序列重叠的可能
功能是检测一个5位二进制序列“10010”。考虑到序列重叠的可能，有限状态机共提供8个状态（包括初始状态IDLE）。
VHDL/FPGA/Verilog 基于FPGA的24C02驱动程序
基于FPGA的24C02驱动程序，使用有限状态机～结构完整，测试通过。
VHDL/FPGA/Verilog finite_state_machines
finite_state_machines，有限状态机，包含多种模式及测试代码
VHDL/FPGA/Verilog 这是一个由得到的命令(地址)从RAM 中读取命令并送入一个名为FUNREG的寄存器的代码,和前面的MINICORE 可以衔接,属于mikroprogrammbar steuerwerk(可编程的控制器
这是一个由得到的命令(地址)从RAM 中读取命令并送入一个名为FUNREG的寄存器的代码,和前面的MINICORE 可以衔接,属于mikroprogrammbar steuerwerk(可编程的控制器) 与FSM (有限状态机)构成的控制器相对