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教程资料  CPLD、FPGA在EL显示模块及接口电路中的应用

CPLD、FPGA在EL显示模块及接口电路中的应用,cpld实现数字电路取代，fpga取代液晶显示专用控制芯片。

https://www.eeworm.com/dl/fpga/doc/18544.html

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教程资料  ALLEGRO 约束规则设置步骤（以DDR 为例）

ALLEGRO 约束规则设置步骤（以DDR 为例）,同样为pdf格式方便大家下载使用

https://www.eeworm.com/dl/cadence/doc/18660.html

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教程资料  基于ARM平台的等精度数字显示频率计的设计

基于ARM平台的等精度数字显示频率计的设计,已通过测试

https://www.eeworm.com/dl/fpga/doc/18700.html

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教程资料  VGA显示的FPGA实现

VGA显示的FPGA实现

https://www.eeworm.com/dl/fpga/doc/18721.html

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教程资料  VGA显示的FPGA实现方法

VGA显示的FPGA实现方法，包括原理和一个小例子。

https://www.eeworm.com/dl/fpga/doc/18746.html

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教程资料  用CPLD控制LED、数码管的显示源代码

工作原理：\r\n 脉冲输入，记录30个脉冲的间隔时间（总时间），LED显示出来，牵涉到数码管的轮流点亮，以及LED的码。输入端口一定要用个\r\n74LS14整一下，图上没有。数码管使用共阴数码管。MAXPLUS编译。\r\n测试时将光电门的信号端一块连接到J2口的第三管脚，同时第一管脚为地，应该与光电门的地连接（共地）。\r\n开始测 ...

https://www.eeworm.com/dl/Protel/doc/18753.html

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教程资料  在Allegro中等长设置的高级应用-Memory部分等长设置

在Allegro中等长设置的高级应用\r\n――Memory部分等长设置

https://www.eeworm.com/dl/cadence/doc/18778.html

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教程资料  Allegro User Preference功能介绍

在这里可以进行工作环境、界面和显示效果的一些设定，执行菜单\r\nSetup>User Preferences出现下面窗体，因为这里涉及的内容比较多，而且很多功\r\n能都很少用到，所以下面只针对一些常用设置作介绍。

https://www.eeworm.com/dl/cadence/doc/18789.html

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教程资料  Allegro中关于XNet的等长设置,为PDF格式

Allegro中关于XNet的等长设置,为PDF格式，方便大家下载使用

https://www.eeworm.com/dl/cadence/doc/18795.html

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教程资料  中文平台在PCB中放置字符串时选择SERF字体可显示中文但打印时乱码

中文平台在PCB中放置字符串时选择SERF字体可显示中文但打印时乱码。\r\n在PCB中打印中文可使用汉字PCBHZ补丁。\r\n步骤：\r\n 1，安装中文平台；\r\n 2，将PCBHZ文件包放入Altium2004根目录；\r\n 3, 将DXP.RCS文件放入C:\\Documents and Settings\\个人文件夹\\Application Data\\Altium2004目录 \r\n 4，重新启动DXP2004. ...

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