搜索结果
找到约 7,631 项符合
时钟频率 的查询结果
按分类筛选
- 全部分类
- 技术资料 (76)
- 学术论文 (56)
- 单片机编程 (52)
- VHDL/FPGA/Verilog (37)
- 单片机开发 (36)
- VIP专区 (32)
- 可编程逻辑 (10)
- 其他 (10)
- 模拟电子 (8)
- 汇编语言 (8)
- 嵌入式/单片机编程 (6)
- 其他 (6)
- PCB相关 (5)
- DSP编程 (5)
- 其他嵌入式/单片机内容 (5)
- 教程资料 (4)
- 电源技术 (4)
- 电子书籍 (3)
- 文章/文档 (3)
- 系统设计方案 (3)
- 技术书籍 (2)
- 通信网络 (2)
- 嵌入式综合 (2)
- 串口编程 (2)
- 软件设计/软件工程 (2)
- 软件 (2)
- 手册 (2)
- 经验 (2)
- 其他文档 (1)
- ALTERA FPGA开发软件 (1)
- 教程资料 (1)
- ARM (1)
- C/C++语言编程 (1)
- 接口技术 (1)
- 嵌入式Linux (1)
- 人物传记/成功经验 (1)
- 中间件编程 (1)
- 文件格式 (1)
- RFID编程 (1)
- 微处理器开发 (1)
- 其他书籍 (1)
- Java编程 (1)
- 编译器/解释器 (1)
- MTK (1)
- 书籍源码 (1)
- uCOS (1)
- 电子元器件应用 (1)
- 无线通信 (1)
- 书籍 (1)
- 应用设计 (1)
- 源码 (1)
- 电路图 (1)
- 精品软件 (1)
其他嵌入式/单片机内容 Holtek单片机源码:此应用示范了使用HT48C10单片机的 16 位定时计数器产生内部中断以实现计时功能。这个应用依靠系统时钟频率作为计时的基准。此处所示的应用使用了 400KHz的系统时钟
Holtek单片机源码:此应用示范了使用HT48C10单片机的 16 位定时计数器产生内部中断以实现计时功能。这个应用依靠系统时钟频率作为计时的基准。此处所示的应用使用了 400KHz的系统时钟,通过内部除四分频产生 100KHz 的定时/计数器时钟。对于一个 16 位的计数器最大计数值为 65536,这将每隔 0.65536 秒产生一个内部中断。但 ...
串口编程 串口通讯rs232,时钟频率为40Mhz,波特率为19200,没有奇偶校验,在xilinx XC3S200A板子上验证过.
串口通讯rs232,时钟频率为40Mhz,波特率为19200,没有奇偶校验,在xilinx XC3S200A板子上验证过.
单片机开发 8952+1602测单片机内部时钟频率C程序
8952+1602测单片机内部时钟频率C程序
单片机开发 这是一个串行通信接口的实例就是在单片机时钟频率在12MHz 波特率 9600bps 的通信方式下实现软件UART的发送程序。
这是一个串行通信接口的实例就是在单片机时钟频率在12MHz 波特率 9600bps 的通信方式下实现软件UART的发送程序。
单片机开发 本例展示了如何利用外设TIM2来产生四路频率不同的信号。 TIM2时钟设置为36MHz
本例展示了如何利用外设TIM2来产生四路频率不同的信号。
TIM2时钟设置为36MHz,预分频设置为2,使用输出比较-翻转模式(Output Compare Toggle Mode)。
TIM2计数器时钟可表达为:TIM2 counter clock = TIMxCLK / (Prescaler +1) = 12 MHz
设置TIM2_CCR1寄存器值为32768,则CC1更新频率为TIM2计数器时钟频率除以CCR1寄存 ...
VHDL/FPGA/Verilog 异步FIFO是用来适配不同时钟域之间的相位差和频率飘移的重要模块。本文设计的异步FIFO采用了格雷(GRAY)变换技术和双端口RAM实现了不同时钟域之间的数据无损传输。该结构利用了GRAY变换的特点
异步FIFO是用来适配不同时钟域之间的相位差和频率飘移的重要模块。本文设计的异步FIFO采用了格雷(GRAY)变换技术和双端口RAM实现了不同时钟域之间的数据无损传输。该结构利用了GRAY变换的特点,使得整个系统可靠性高和抗干扰能力强,系统可以工作在读写时钟频率漂移达到正负300PPM的恶劣环境。并且由于采用了模块化结构, ...
教程资料 异步FIFO是用来适配不同异步FIFO采用了格雷(GRAY)变换技术和双端口RAM实现了不同时钟域之间的数据无损传输
异步FIFO是用来适配不同时钟域之间的相位差和频率飘移的重要模块。本文设计的异步FIFO采用了格雷(GRAY)变换技术和双端口RAM实现了不同时钟域之间的数据无损传输。该结构利用了GRAY变换的特点,使得整个系统可靠性高和抗干扰能力强,系统可以工作在读写时钟频率漂移达到正负300PPM的恶劣环境。并且由于采用了模块化结构, ...
教程资料 FPGA和PC机之间串行通信对输出正弦波频率的控制
1、 利用FLEX10的片内RAM资源,根据DDS原理,设计产生正弦信号的各功能模块和顶层原理图; 2、 利用实验板上的TLC7259转换器,将1中得到的正弦信号,通过D/A转换,通过ME5534滤波后在示波器上观察; 3、 输出波形要求: 在输入时钟频率为16KHz时,输出正弦波分辨率达到1Hz; 在输入时钟频率为4MHz时,输出正弦波分辨率达到2 ...
模拟电子 时钟分相技术应用
摘要: 介绍了时钟分相技术并讨论了时钟分相技术在高速数字电路设计中的作用。
关键词: 时钟分相技术; 应用
中图分类号: TN 79 文献标识码:A 文章编号: 025820934 (2000) 0620437203
时钟是高速数字电路设计的关键技术之一, 系统时钟的性能好坏, 直接影响了整个电路的
性能。尤其现代电子系统对性能的越来越高 ...
单片机编程 决定系统时钟频率的寄存器
关于系统时钟的一些寄存器