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教程资料  基于FPGA的时钟跟踪环路的设计

提出了一种基于FPGA的时钟跟踪环路的设计方案,该方案简化了时钟跟踪环路的结构,降低了时钟调整电路的复杂度。实际电路测试结果表明,该方案能够使接收机时钟快速准确地跟踪发射机时钟的变化,且时钟抖动小、稳准度高、工作稳定可靠。 ...

https://www.eeworm.com/dl/fpga/doc/32648.html

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教程资料  Xilinx FPGA全局时钟资源的使用方法

目前，大型设计一般推荐使用同步时序电路。同步时序电路基于时钟触发沿设计，对时钟的周期、占空比、延时和抖动提出了更高的要求。为了满足同步时序设计的要求，一般在FPGA设计中采用全局时钟资源驱动设计的主时钟，以达到最低的时钟抖动和延迟。 FPGA全局时钟资源一般使用全铜层工艺实现，并设计了专用时钟缓冲与驱动结构 ...

https://www.eeworm.com/dl/fpga/doc/32677.html

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教程资料  采用高速串行收发器Rocket I/O实现数据率为2.5 G

摘要: 串行传输技术具有更高的传输速率和更低的设计成本, 已成为业界首选, 被广泛应用于高速通信领域。提出了一种新的高速串行传输接口的设计方案, 改进了Aurora 协议数据帧格式定义的弊端, 并采用高速串行收发器Rocket I/O, 实现数据率为2.5 Gbps的高速串行传输。关键词: 高速串行传输; Rocket I/O; Aurora 协议为促使FPG ...

https://www.eeworm.com/dl/fpga/doc/32703.html

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嵌入式综合  STM32时钟控制RCC探究

有关RCC时钟配置的

https://www.eeworm.com/dl/566/35181.html

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嵌入式综合  MSP430时钟配置

关于MSP430 时钟的配置

https://www.eeworm.com/dl/566/35521.html

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嵌入式综合  基于FM1702SL的射频读写器

系统设计　　系统框图如图1所示，系统由MCU、键盘、EEPROM、FMl702SL、液晶屏、485通信模块组成。MCu控制FMl702对Mifare卡进行读写操作，再根据得到的相应数据对液晶屏、EEPROM进行相应的操作。MCU 与PC机通过485,总线通信，即使PC机与MCU之间通信发生异常，MCU也可以独立工作，在与PC机通信恢复之后，MCU可以将备份在EEPR ...

https://www.eeworm.com/dl/566/35718.html

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　　核心板配置　　&#61656; 核心板配置癿FPGA芯片是Cyclone II系列癿EP2C8Q208C，具有8256个LEs，36个M4K RAM blocks (4Kbits plus 512 parity bits)，同时具有165,888bit癿RAM，支持18个Embedded multipliers和2个PLL，资源配备十分丰富。实验证明，返款芯片在嵌入NIOS II软核将黑釐开収板癿所有外讴全部跑起来，仅占全 ...

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C/C++语言编程  单片机简易时钟

单片机简易时钟

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C/C++语言编程  1602与DS1302时钟

1602与DS1302时钟

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C/C++语言编程  最新发布AD9850模块相关资料125M参考时钟

最新发布AD9850模块相关资料125M参考时钟

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