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VHDL/FPGA/Verilog Quartus环境下的正选信号发生器的实验源码

Quartus环境下的正选信号发生器的实验源码

https://www.eeworm.com/dl/663/182830.html

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软件设计/软件工程  是关于DS1302的例子.希望对大家能有所帮助.在使用时钟芯片的时候可以使你的设计简单,准确

是关于DS1302的例子.希望对大家能有所帮助.在使用时钟芯片的时候可以使你的设计简单,准确

https://www.eeworm.com/dl/684/182897.html

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嵌入式/单片机编程  这是时钟芯片时SD2304的底层访问函数。希望大家能有用。

这是时钟芯片时SD2304的底层访问函数。希望大家能有用。

https://www.eeworm.com/dl/647/183137.html

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汇编语言  自己写的汇编程序有时钟功能,可重置时钟,是我自己觉得写的不错的1个程序

自己写的汇编程序有时钟功能,可重置时钟,是我自己觉得写的不错的1个程序

https://www.eeworm.com/dl/644/183523.html

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汇编语言  汇编语言时钟程序

汇编语言时钟程序，已经调试运行成功了的．很不错的．需要的朋友请下载．

https://www.eeworm.com/dl/644/183701.html

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汇编语言  回走的时钟

回走的时钟，时间与电脑上的一致哦！制作有点小难度，不过认真了就OK了。

https://www.eeworm.com/dl/644/183746.html

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汇编语言  电子时钟的设计,这是通过汇编语言精心编制而成,请大家多多关照

电子时钟的设计,这是通过汇编语言精心编制而成,请大家多多关照

https://www.eeworm.com/dl/644/183795.html

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单片机开发  时钟芯片-DS1302的程序

时钟芯片-DS1302的程序，用汇编语言编写而成！

https://www.eeworm.com/dl/648/183818.html

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嵌入式/单片机编程  verilog实现电子时钟模块

verilog实现电子时钟模块，输入60Hz时钟信号和复位，输出时分秒，共6位，每位7段输出用于驱动

https://www.eeworm.com/dl/647/183930.html

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软件设计/软件工程  dds信号发生器程序设计

dds信号发生器程序设计，框图，基于CPLD控制的DDS数字频率合成器设计

https://www.eeworm.com/dl/684/183941.html

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